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电动汽车感应电机驱动系统矢量控制的双CPU实现
·摘要： 为电动汽车感应电动机驱动系统设计开发一套矢量控制系统,其硬件系统是通过双CPU-单片机80C196KC和数字信号处理器(DSP)TMS320F240来实现的.通过坐标变换得到了适...
cpu
中央处理器（centralprocessingunit，简称CPU）作为计算机系统的运算和控制核心，是信息处理、程序运行的最终执行单元。CPU自产生以来，在逻辑结构、运行效率以及功能外延上取得了巨大发展。[1]
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基于FPGA的小型CPU中通信协议的研究及IPCore的开发.rar
FPGA作为新一代集成电路的出现，引起了数字电路设计的巨大变革。随着FPGA工艺的不断更新与改善，越来越多的用户与设计公司开始使用FPGA进行系统开发，因此，PFAG的市场需求也越来越高，从而使得FP...
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在DSP组成的多CPU系统设计中双端口RAM的应用研究
·摘要： 在设计多CPU及其他高速数字处理系统时,数据获取及交换是多CPU系统的重要组成部分.当多个CPU对共享内存进行访问时不发生冲突是系统设计能否成功的关键.双口RAM是一种性能优越、...
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实用c程序:16进制<->10进制互换程序 89C51系列CPU编程器接收CPU程序 HT1380实时时钟驱动程序 单个汉字库字摸提取程序
实用c程序:16进制<->10进制互换程序 89C51系列CPU编程器接收CPU程序 HT1380实时时钟驱动程序 单个汉字库字摸提取程序，tc2.0编译 按键扫描驱动程序...
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使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG
使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG，一个堆栈寄存器STACK。存储器寻址粒度为字节。数据存储以32位...
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文章描述了TMS320C6000 digital signal processors (DSPs)的CPU结构、管道技术、指令系统.
文章描述了TMS320C6000 digital signal processors (DSPs)的CPU结构、管道技术、指令系统....
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ucos-ii 编译器ICCAVR CPU atmega8 8M 晶振 对原作者的ucos进行了简化
ucos-ii 编译器ICCAVR CPU atmega8 8M 晶振 对原作者的ucos进行了简化，去掉了 hook，保留了基本功能 代码精简，编译后代码占 mage8 的 49% 时钟使用time...
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这是一个C51做的GPS终端 CPU：89S52 语言： Keil C51 主要是RS232通信
这是一个C51做的GPS终端 CPU：89S52 语言： Keil C51 主要是RS232通信...