Viterbi译码

接收到的符号首先经过解调器判决，输出0、1码，然后再送往译码器的形式，称为硬判决译码。即编码信道的输出是0、1的硬判决信息。

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给出了由(2 ,1 ,N) 系列卷积码作为母码产生的punctured 卷积码的编码及其Viterbi 译码的 软件实现方法,从而为各种不同码率的卷积码的编、译码给出了一种通用的实现方法,并且为多级 编码分量码的设计提供了条件

2013-11-30 129 Viterbi译码

内有LED译码器，汉明纠错译码器，地址译码器，最高优先译码器，双2－4译码器等VHDL的源代码

2015-04-15 47 Viterbi译码