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Verilog HDL语言在FPGA实现中的存储器的使用详细说明
用VERILOG语言实现了J-K触发器,可综合可仿真通过
SPI串口的内核实现（分别使用verilog和vhdl语言描述的）
verilog实现的奇数分频器 针对任何规模的奇数分频
verilog语言实现的基于MIPS体系结构的微处理器程序，一个时钟周期执行一条指令。
verilog，4、5分频器，5分频器占空比3：2
涵盖Verilog语言从基础语法到实际电路设计的完整技术栈，适合初学者和进阶者掌握硬件开发核心技能。
verilog，hdl的循环冗余码的编码解码器，里面有三个文档。
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