Verilog+Code

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以太网的vhdl和verilog代码，供大家学习

2013-12-17 117 Verilog+Code

循环码编码器verilog实现，里面包含有源程序和仿真图。

2016-05-31 97 Verilog+Code

2016-06-01 97 Verilog+Code

自动增益控制Verilog编程，本程序开发环境为xilinx ISE7.1

2014-01-04 148 Verilog+Code

verilog实现电子时钟模块，输入60Hz时钟信号和复位，输出时分秒，共6位，每位7段输出用于驱动

2015-08-13 55 Verilog+Code

verilog HDL实现先进先出栈，不含测试文件

2015-08-20 56 Verilog+Code

verilog实现16*16位乘法器，带测试文件

2013-12-18 118 Verilog+Code

verilog 入门电子学习资料，看完之后对你一定有很大帮助

2016-05-01 89 Verilog+Code