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VHDL/FPGA/Verilog
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循环码编码器verilog实现
循环码编码器verilog实现
VHDL/FPGA/Verilog
16 K
97 次下载
2016-05-31
资源详细信息
文件格式
压缩包
文件大小
16 K
资源分类
VHDL/FPGA/Verilog
上传者
w277426078
发布时间
2016-05-31 10:28
下载统计
97
次
所需积分
2 积分
循环码编码器verilog实现 - 资源详细说明
循环码编码器verilog实现,里面包含有源程序和仿真图。
循环码编码器verilog实现 - 源码文件列表
本资源包含 6 个源码文件
支持在线预览,点击文件名即可查看
1
crc_3.txt
查看源码
2
crc_3_test.v
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3
crc_3.v
查看源码
4
crc_3_testbench.txt
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5
1.bmp
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6
2.bmp
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#循环码
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