VHDL代码
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用VHDL硬件描述语言实现的对FPGA（Cyclone II）的配置的VHDL源代码。
用VHDL硬件描述语言实现的对FPGA（Cyclone II）的配置的VHDL源代码。
2015-04-02
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用VHDL语言设计维特比 解码器 是VHDL原代码用ModelSim XE III 6.3c软件实现仿真
用VHDL语言设计维特比 解码器 是VHDL原代码用ModelSim XE III 6.3c软件实现仿真
2013-12-09
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