SystemC to VERilog 转换源程序。
标签： SystemC VERilog to 转换
上传时间： 2015-02-19
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用VERilog写的跑表程序
标签： VERilog 跑表 程序
上传时间： 2014-01-18
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用VERilog编写的多功能数字钟
标签： VERilog 编写 多功能 数字
上传时间： 2015-02-25
上传用户：王者A
IEEE Std 1364.1-2002 IEEE Std. 1364.1 - 2002 IEEE Standard for VERilog Register Transfer Level Synthesis.rar
标签： IEEE 1364.1 2002 Std
上传时间： 2013-12-23
VERilog源码14.rar
标签： VERilog 14 源码
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VERilog源码13.rar
标签： VERilog 13 源码
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VERilog源码15.rar
标签： VERilog 15 源码
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VERilog源码10.rar
标签： VERilog 10 源码
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VERilog源码9.rar
标签： VERilog 源码
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VERilog源码11.rar
标签： VERilog 11 源码
上传时间： 2014-11-28
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