VERILOG

VerilogHDL是一种硬件描述语言,以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。VerilogHDL和VHDL是世界上最流行的两种硬件描述语言,都是在20世纪80年代中期开发出来的。前者由GatewayDesignA...

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使用Verilog编写的同步FIFO,可通过设置程序中的DEPTH设置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中写入数据, FIFO_READ_CLOCK上升沿读取数据。本程...

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用verilog实现的数字跑表,下载到FPGA开发板上验证通过。下载后从新分配引脚即可用。...

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使用verilog 写的FIR滤波器,里面并有matlab程序,是从altera官网下来的。。希望对大家游泳。...

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里面有大量Verilog的实例,是从一本书中摘取过来的,对verilog有一定了解的人有很大的帮助...

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