在原来基础上新添加了对ST、V、I、C卡的处理
在原来基础上新添加了对ST、V、I、C卡的处理，并给出了怎样使一台机顶盒支持 多种智能卡的伪代码！...
V-AC技术资料
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💻 源代码：457236
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dvb ca 移植接口代码及文档说明。有对ST、V、I、C卡的处理说明
dvb ca 移植接口代码及文档说明。有对ST、V、I、C卡的处理说明，并给出了怎样使一台机顶盒支持多种智能卡的伪代码！...
HT46R47對AC過零信號進行檢測
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各功能描述: 1. 当A为低电平时,AC-3灯点亮,即是AC-3的输入方式 当A为高电平时,STEREO灯点亮,即是STEREO的输入方式 2. 当STANDBY灯点亮时
各功能描述: 1. 当A为低电平时,AC-3灯点亮,即是AC-3的输入方式 当A为高电平时,STEREO灯点亮,即是STEREO的输入方式 2. 当STANDBY灯点亮时，为待机状态；此LED闪...
FPGA程序的top.v文件
FPGA程序的top.v文件，主要实现DDS信号发生器功能，通过定时器，可简单实现输出幅值无极跳变...
wz_jsgraphics.js v. 2.3 div画图类
wz_jsgraphics.js v. 2.3 div画图类，包括很多div的应用。...
IIR code. IEEE STD 1364-1995 Verilog file: iir_par.v.
IIR code. IEEE STD 1364-1995 Verilog file: iir_par.v....
oracle带的包常用函数.v$rollstat與v$undostat两者的区别
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北大ACM题库中的部分已AC题目源码（1001
北大ACM题库中的部分已AC题目源码（1001，1002，1003，1004，1005，1006，1007，1008）...
本程序包含：EEPROM的功能模型(eeprom.v)、读/写EEPROM的verilog HDL 行为模块（eeprom_wr.v）、信号产生模块（signal.v）和顶层模块(top.v)
本程序包含：EEPROM的功能模型(eeprom.v)、读/写EEPROM的verilog HDL 行为模块（eeprom_wr.v）、信号产生模块（signal.v）和顶层模块(top.v) ，这样...