XAPP953-二维列序滤波器的实现
This application note describes the implementation of a two-dimensional Rank Order filter...
Rtl技术资料
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Verilog Coding Style for Efficient Digital Design
In this paper, we discuss efficient coding and design styles using verilog. This can beim...
DC逻辑综合
芯片综合的过程：芯片的规格说明，芯片设计的划分，预布局，RTL 逻辑单元的综合，各逻辑单元的集成，测试，布局规划，布局布线，最终验证等步骤。设计流程与思想概述：一个设计从市场需求到实际应用需要运用...
基于FPGA 的方向滤波器指纹图像增强算法实现
设计了一种基于FPGA纯硬件方式实现方向滤波的指纹图像增强算法。设计采用寄存器传输级（RTL）硬件描述语言（Verilog HDL），利用时分复用和流水线处理等技术，完成了方向滤波指纹图像增强算法在F...
SystemC片上系统设计的源代码： 书籍介绍： SystemC是被实践证明的优秀的系统设计描述语言
SystemC片上系统设计的源代码： 书籍介绍： SystemC是被实践证明的优秀的系统设计描述语言，它能够完成从系统到门级、从软件到硬件、从设计到验证的全部描述。SystemC 2.01已作为一...
fsmlabs的real time linux的内核
fsmlabs的real time linux的内核，版本rtl-3.2-pre...
linux下的SPI总线驱动程序
linux下的SPI总线驱动程序，CPU是RTL的86系列，以legerity的SLIC chip为驱动对象。供大家参考。...
Hard-decision decoding scheme Codeword length (n) : 31 symbols. Message length (k) : 19 symbols.
Hard-decision decoding scheme Codeword length (n) : 31 symbols. Message length (k) : 19 symbols....
44b0X开发板 CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL
44b0X开发板 CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL...
verilog编写
verilog编写，rtl风格，流水线设计，实现图像rgb格式到yuv格式的转换。...