RAM+Core
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用比较器A进行斜边AD转换程序。 430F149:16位单片机平台,64K flash,2K RAM MCLK：8MHz ACLK：32.768kHz
2013-12-22
116
用VHDL硬件描述语言开发的miniUART接口IP Core,用户可以将其嵌入到自己的FPGA模块中。
用VHDL硬件描述语言开发的miniUART接口IP Core,用户可以将其嵌入到自己的FPGA模块中。
2015-07-22
67
用walsh算法实现的符号数乘法器,asic流片时,可以不用公司的付费乘法器的ip core.
用walsh算法实现的符号数乘法器,asic流片时,可以不用公司的付费乘法器的ip core.
2015-06-22
163
RAM存储器： 设定16 个8 位存储单元。如果read= 1 则dataout<=mem(conv_integer(address)). 如果write= 1 则mem(conv_intege
RAM存储器： 设定16 个8 位存储单元。如果read= 1 则dataout<=mem(conv_integer(address)). 如果write= 1 则mem(conv_integer(address))<=data...
2014-10-27
86
任意时钟配比的异步fifo.含有synplify ip库中的双端口ram。用于处理多时钟域问题。
任意时钟配比的异步fifo.含有synplify ip库中的双端口ram。用于处理多时钟域问题。
2014-12-04
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