QC-LDPC码
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基于FPGA的LDPC码的实现.rar
低密度校验码(LDPC)是一种能逼近Shannon容量限的渐进好码,其长码性能甚至超过了Turbo码。低密度校验码以其迭代译码复杂度低,没有错误平层,码率和码长可灵活改变的优点成为Turbo码强有力的竞争对手。目前,LDPC码已广泛应用于深...
IEEE 802.16e中LDPC译码器的实现
面向IEEE 802.16e 中 LDPC 码,分析了各种译码算法的译码性能,归一化最小(NMS)算法具备较高译码性能和实现复杂度低的特点。提出一种基于部分并行方式的LDPC 译码器结构,可以满足IE
IEEE802.16e标准LDPC译码器FPGA设计
LDPC码自在上个世纪九十年代被重新发现以来,以其接近香农极限的纠错性能,以及译码复杂度低、吞吐率高的优点引起了人们的关注,成为继Turbo码之后信道编码界的又一研究热点。如今,LDPC码已经广泛应用于DVB-S2、CMMB以及Wi-...
RS码、LDPC码级联编解码器的FPGA实现
差错控制编码技术是现代通信技术中的关键技术之一,在移动通信、数字电视、计算机存储等数据通信系统中得到了广泛应用。在信道条件恶劣的情况中,常采用纠错能力更强的级联编解码方法,进行差错控制。本课题以RS码、LDPC 码...
RS码、LDPC码级联编解码器的FPGA实现
差错控制编码技术是现代通信技术中的关键技术之一,在移动通信、数字电视、计算机存储等数据通信系统中得到了广泛应用。在信道条件恶劣的情况中,常采用纠错能力更强的级联编解码方法,进行差错控制。本课题以RS码、LDPC 码...
LDPC码编译码算法的研究与实现
本文首先介绍了几种LDPC码的编译码算法,同时推导了译码错误概率和密度进化 过程,讨论了信道参数的门限效应。接着对LDPC码二分图中长度为4的环进行了深入 研究,提出了一种LDPC码校验矩阵的消4一环生成算法,采用Matlab和VC++融合...
多元LDPC码译码器设计与FPGA实现
低密度校验(LDPC)码被证明是一类纠错性能逼近Shannon限的好码。多元 LDPC码与二元LDPC码相比性能更好,然而,这是以高译码复杂度为代价的。本文作者结合国家863计划项目(2006AA01Z267),对多元LDPC码译码器的设计...