准循环LDPC码的半并行译码器设计
准循环LDPC码的半并行译码器设计，利用准循环LDPC 码的结构特点!使用半并行结构的译码器可以实现复杂度和译码速率的有效折中" 提出了一种半并行 结构的实现方法!并通过FPGA 上的实现验证了性能"...
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查看全部391个资源 »高吞吐量LDPC码编码构造及其FPGA实现
低密度校验码（LDPC，Low Density Parity Check Code）是一种性能接近香农极限的信道编码，已被广泛地采用到各种无线通信领域标准中，包括我国的数字电视地面传输标准、欧洲第二代卫星数字视频广播标准（DVB-S2，Digital Video Broadcasting-Satel...
应用循环移位矩阵设计LDPC码译码器
通过对DVB-S2和WiMAX等标准中的实用LDPC码的分析，导出了其共同的基于循环移位矩阵的校验阵结 构；设计了一种基于循环移位矩阵的LDPC码译码器，该译码器拥有每行块(列块)逐块、逐行块(列块)的半并行译码机 制、通用的外信息存储单元和串行运算单元，可以用相同的结构实现不同码率的各种LDP...
高吞吐量LDPC码编码构造及其FPGA实现
低密度校验码（LDPC，Low Density Parity Check Code）是一种性能接近香农极限的信道编码，已被广泛地采用到各种无线通信领域标准中，包括我国的数字电视地面传输标准、欧洲第二代卫星数字视频广播标准（DVB-S2，Digital Video Broadcasting-Satel...
基于FPGA的LDPC码译码研究与硬件实现
低密度奇偶校验(LDPC)码是基于稀疏校验矩阵的线性分组码，它是继Turbo码后在纠错编码领域的又一重大进展。研究表明当码长足够长时，LDPC码具有比Turbo码更为优良的性能，并且其译码复杂度低于Turbo码。目前LDPC已被多家通信公司定为第四代移动通信手机中的纠错编码方案，因此LDPC码编译码...
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