ISE设计
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500
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RS(204,188)译码器的设计 异步FIFO设计 伪随即序列应用设计 CORDIC数字计算机的设计 CIC的设计 除法器的设计 加罗华域的乘法器设计
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2017-01-24
138
UART 的VHDL源代码。可在ISE, Max-Plus II,等开发环境下实现。
UART 的VHDL源代码。可在ISE, Max-Plus II,等开发环境下实现。
2013-12-16
110
在文件夹YL2440_CPLD中有做好的CPLD工程,请用Xilinx ISE 6.2打开.
在文件夹YL2440_CPLD中有做好的CPLD工程,请用Xilinx ISE 6.2打开.
2014-01-26
45