HDL+Coder
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746
HDL+Coder 全部资料 746 份
Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。
Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。
2014-01-15
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中文名称为：硬件描述语言 Verilog（第四版）。讲解verilog HDL的经典图书。Thomas和Moorby编著
中文名称为：硬件描述语言 Verilog（第四版）。讲解verilog HDL的经典图书。Thomas和Moorby编著，内容涵盖了:行为建模、并发进程、逻辑级建模、高级时序、逻辑综合、行为综合等方面的内容。通读此书后，不需要再读其他的ve...
2014-01-07
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这是关于如何使用Mentor社的ModelSim软件的说明书。ModelSim是HDL simulator中最常用的一个。
这是关于如何使用Mentor社的ModelSim软件的说明书。ModelSim是HDL simulator中最常用的一个。
2016-07-11
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多功能数字钟设计 一、设计任务： （一）主体功能 用HDL设计一个多功能数字钟
多功能数字钟设计 一、设计任务： （一）主体功能 用HDL设计一个多功能数字钟，包含以下主要功能： 1.计时及校时，时间可以24小时制或12小时制显示 2.日历：显示年月日星期，及设定设定功能 3.跑表：启动/停止/保持显示/清...
2013-12-31
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数字集成电路设计入门 --从HDL到版图 于敦山 北大微电子学系 Verilog完整课件
数字集成电路设计入门 --从HDL到版图 于敦山 北大微电子学系 Verilog完整课件，是学习verilog HDL的很好的参考资料。
2013-12-23
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EDA开发教程,初学者的宝典!主要讲述了verilog HDL编程方法,非常适合初学Verilog者.
EDA开发教程,初学者的宝典!主要讲述了verilog HDL编程方法,非常适合初学Verilog者.
2013-12-19
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异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
2014-11-05
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用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。
用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。
2015-05-02
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使用FPGA控制蜂鸣器的程序,用Verilog HDL设计,可以是蜂鸣器发出各种不同的声音
使用FPGA控制蜂鸣器的程序,用Verilog HDL设计,可以是蜂鸣器发出各种不同的声音
2013-12-21
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