FPGA的机器人<b>视觉</b>系统

Alter FPGA的设计流程以及DSP设计

Alter FPGA的设计流程以及DSP设计.

标签： Alter FPGA DSP 设计流程

上传时间： 2013-11-13

上传用户：caixiaoxu26
赛灵思如何让7系列FPGA的功耗减半

赛灵思采用专为 FPGA 定制的芯片制造工艺和创新型统一架构，让 7 系列 FPGA 的功耗较前一代器件降低一半以上。

标签： FPGA 赛灵思功耗减

上传时间： 2013-11-18

上传用户：liaofamous
WP374 Xilinx FPGA的部分重配置

WP374 Xilinx FPGA的部分重配置

标签： Xilinx FPGA 374 WP

上传时间： 2013-11-11

上传用户：zhaoke2005
FPGA的基本结构

首先得掌握FPGA的芯片结构

标签： FPGA 基本结构

上传时间： 2013-12-29

上传用户：yph853211
基于FPGA的时钟跟踪环路的设计

提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。

标签： FPGA 时钟跟踪环路

上传时间： 2014-12-28

上传用户：498732662
基于Actel FPGA的双端口RAM设计

基于Actel FPGA 的双端口RAM 设计双端口RAM 芯片主要应用于高速率、高可靠性、对实时性要求高的场合，如实现DSP与PCI 总线芯片之间的数据交换接口电路等。但普通双端口RAM 最大的缺点是在两个CPU发生竞争时，有一方CPU 必须等待，因而降低了访问效率。IDT 公司推出的专用双端口RAM 芯片解决了普通双端口RAM 内部竞争问题，并融合了中断、旗语、主从功能。它具有存取速度快、功耗低、可完全异步操作、接口电路简单等优点，但缺点也非常明显，那就是价格太昂贵。为解决IDT 专用双端口RAM 芯片的价格过高问题，广州致远电子有限公司推出了一种全新的基于Actel FPGA 的双端口RAM 的解决方案。该方案采用Actel FPGA 实现，不仅具有IDT 专用双端口RAM 芯片的所有性能特点，更是在价格上得到了很大改善，以A3P060双端口RAM 为例，在相同容量（2K 字节）下，其价格仅为IDT 专用芯片的六分之一。

标签： Actel FPGA RAM 双端口

上传时间： 2013-10-22

上传用户：blacklee
AES中SubBytes算法在FPGA的实现

介绍了AES中,SubBytes算法在FPGA的具体实现.构造SubBytes的S-Box转换表可以直接查找ROM表来实现.通过分析SubBytes算法得到一种可行性硬件逻辑电路,从而实现SubBytes变换的功能.

标签： SubBytes FPGA AES 算法

上传时间： 2013-11-30

上传用户：hzy5825468
基于FPGA的数字三相锁相环的优化设计

数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿真和实验结果表明，优化后的数字三相锁相环大大节省了FPGA的资源，并能快速、准确地锁定相位，具有良好的性能。

标签： FPGA 数字三相优化设计

上传时间： 2013-11-15

上传用户：yjj631
基于FPGA 的单精度浮点数乘法器设计

设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发板上进行了验证.

标签： FPGA 精度浮点数乘法器设计

上传时间： 2013-10-09

上传用户：xjy441694216
基于STM32和FPGA的CAN总线运动控制器的设计

运用低功耗C0rtex-M3微控制器STM32F103VBT6和FPGA芯片设计一种基于CAN总线的运动控制器。介绍系统的体系结构、主要硬件设计和软件结构。利用FPGA高速处理能力实现控制算法，与外界通信采用STM32和CAN总线技术，系统稳定可靠，另外，将设计好的FPGA程序或是C程序进行封装，系统的可移植性强。

标签： FPGA STM CAN 32

上传时间： 2013-10-30

上传用户：woshini123456