EXE合并
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FIFO的Verilog程序 已在modelsim中编译通过 并且可以通过DC进行综合
FIFO的Verilog程序 已在modelsim中编译通过 并且可以通过DC进行综合
2015-11-22
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基于混合伪并行遗传算法的BLDCM转速控制系统的优化设计
·摘 要:本文以无刷直流电动机作为被控对象,运用混合伪并行遗传算法(MPPGA)对其转速控制器的PI参数进行了优化设计,该算法针对常规遗传算法搜索效率低和早熟收敛的缺点,通过将最速下降法与伪并行遗传算法相组合形成了一种全局优化算法,并使用M...
2023-05-28
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并行接口
7.1 并行接口概述并行接口和串行接口的结构示意图并行接口传输速率高,一般不要求固定格式,但不适合长距离数据传输7.2 可编程并行接口芯片82C55 7.2.1 8255的基本功能 8255...
2013-10-25
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