CPLD+VHDL

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vhdl硬件设计实现一个数字上变频器，实现数字上变频

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2014-01-13 179 CPLD+VHDL

VHDL写的通用调制解调器的核心程序，通过调试无错无警告

2017-08-13 154 CPLD+VHDL

用VHDL语言实现一个10秒倒计时电路，要求使用8*8点阵显示计时结果

2013-12-09 124 CPLD+VHDL

该程序是用VHDL语言实现的时钟程序，用六个数码管分别显示时分秒，而且可以实现控制功能。

2013-12-23 102 CPLD+VHDL

一本国外的学习VHDL设计的经典教材，而且内附很多的例子

2014-01-16 54 CPLD+VHDL

VHDL编写的基于FPGA的4-8交织器代码，有需要的下来看看

2017-08-20 161 CPLD+VHDL

用VHDL语言实现8421码的十进制计数器，状态变化0000->0001->0010->0011->0100->0101->0110->0111->1000->0000.循环往复。

2013-12-08 41 CPLD+VHDL