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VHDL设计——16位A/D转换器的设计
VHDL设计——16位D/A转换器的设计
用VHDL设计了一种2DPSK信号产生器,测试和实际应用表明其性能稳定可靠。
4位汉明编译码源代码。VHDL格式,经过仿真和测试通过,请放心使用。
用vhdl写的有关寄存器的源代码,适合于硬件开发入门。
8.9 PSK调制与解调VHDL程序及仿真
用vhdl设计实现的多功能电子钟,可有日历,闹钟,修改等多种功能
VHDL语言设计;功能描述:键盘扫描,不包含去抖电路
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