CPLD+VHDL

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这是一个非常好的VHDL的源码，学这个的朋友可以下了看看，比较简单的一个东西，初学都非常适合

2013-12-23 126 CPLD+VHDL

一个用VHDL语言编写的全加器，是数字电路EDA设计的一个例子，可能不太特别，但是应该可以用一下的。

2014-10-29 186 CPLD+VHDL

用VHDL结构描述设计一全减器，全减器可由两个半减器和一个或门组成。

2013-12-22 60 CPLD+VHDL

电梯控制的VHDL程序及其仿真，用的是MAX+PLUSii，要下的顶

2013-12-23 149 CPLD+VHDL

一些vhdl的简单例子。直接解压，不用密码。

2015-06-21 200 CPLD+VHDL

2014-11-24 153 CPLD+VHDL

此硬件仿真程序选用VHDL编译，上传的是它的实验报告，其中包括全部源码和报告分析

2015-09-03 179 CPLD+VHDL

2013-12-11 138 CPLD+VHDL