CPLD+VHDL

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此程序采用VHDL语言，完成四位二进制数的加法，并且输出是BCD码

2014-01-15 50 CPLD+VHDL

此程序采用VHDL语言，完成在16位十六进制加法器的基础上将输出进行BCD码转换，实现输出是BCD码的16位二进制加法器

2016-06-18 107 CPLD+VHDL

此程序采用VHDL语言，完成在32位十六进制加法器的基础上将输出进行BCD码转换，实现输出是BCD码的32位二进制加法器

2016-06-18 118 CPLD+VHDL

此程序采用VHDL语言，利用元件例化语句，在带BCD码转换的4位加法器的基础上完成8位加法器的例化

2016-06-18 79 CPLD+VHDL

介绍VHDL中库的调用，使对库的调用有深入的了解

2014-01-12 200 CPLD+VHDL

用VHDL编译的源代码，模仿心脏跳动，解压后直接用Quartus打开project即可

2013-12-15 96 CPLD+VHDL

用VHDL编译的源代码，可编程脉冲生成器，解压后直接用Quartus打开project即可

2013-12-02 171 CPLD+VHDL

用VHDL编译的源代码，模拟心脏跳动，解压后直接用Quartus打开project即可，不好意思刚才第一个那个模拟心脏跳动（heartbeat）的源程序发错了，请删除，

2014-01-10 26 CPLD+VHDL