CORE

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共 335 份资源

CORE 全部资料 335 份

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FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE 第一章 Modelsim编译Xilinx库第二章调用Xilinx CORE-Generato

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为基于ARM核心的ST微控制器提供的量产编程方案 (Production programming solutions for ST ARM™ core-bas

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用walsh算法实现的符号数乘法器,asic流片时,可以不用公司的付费乘法器的ip core.

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用VHDL硬件描述语言开发的miniUART接口IP Core,用户可以将其嵌入到自己的FPGA模块中。

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经本人优化后的计算 MD5 的类 CMD5 类及动态库源程序,单线程在 Core 6320 CPU,DDR2 667内存时,忽略读取硬盘速度,每秒可计算150MB以上的数据,可直接做为计算MD5的工

经本人优化后的计算 MD5 的类 CMD5 类及动态库源程序,单线程在 Core 6320 CPU,DDR2 667内存时,忽略读取硬盘速度,每秒可计算150MB以上的数据,可直接做为计算MD5的工...

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CORE 全部资料 335 份

FPGA设计全流程：Modelsim&gt;&gt;Synplify.Pro&gt;&gt;ISE 第一章 Modelsim编译Xilinx库 第二章 调用Xilinx CORE-Generato

为基于ARM核心的ST微控制器提供的量产编程方案 (Production programming solutions for ST ARM&trade; core-bas

用walsh算法实现的符号数乘法器,asic流片时,可以不用公司的付费乘法器的ip core.

用VHDL硬件描述语言开发的miniUART接口IP Core,用户可以将其嵌入到自己的FPGA模块中。

经本人优化后的计算 MD5 的类 CMD5 类及动态库源程序,单线程在 Core 6320 CPU,DDR2 667内存 时,忽略读取硬盘速度,每秒可计算150MB以上的数据,可直接做为计算MD5的工

CORE技术资料简介

FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE 第一章 Modelsim编译Xilinx库第二章调用Xilinx CORE-Generato

为基于ARM核心的ST微控制器提供的量产编程方案 (Production programming solutions for ST ARM™ core-bas

经本人优化后的计算 MD5 的类 CMD5 类及动态库源程序,单线程在 Core 6320 CPU,DDR2 667内存时,忽略读取硬盘速度,每秒可计算150MB以上的数据,可直接做为计算MD5的工