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C 连接数据库方式<b>ado</b>

  • a.本程序在Windows xp 上调试通过。 b.在使用时先用ODBC注册数据源

    a.本程序在Windows xp 上调试通过。 b.在使用时先用ODBC注册数据源,数据源名:addresslist(名称不可以写错) c.第一次运行时,密码为空。进入系统后可以修改密码。

    标签: a. b. Windows ODBC

    上传时间: 2015-12-09

    上传用户:sjyy1001

  • VIIC_C51.C此程序是I2C操作平台(主方式的软件平台)的底层的C子程序,如发送数据 及接收数据,应答位发送,并提供了几个直接面对器件的操作函数

    VIIC_C51.C此程序是I2C操作平台(主方式的软件平台)的底层的C子程序,如发送数据 及接收数据,应答位发送,并提供了几个直接面对器件的操作函数,它很方便的 与用户程序连接并扩展..... 注意:函数是采用软件延时的方法产生SCL脉冲,固对高晶振频率要作 一定的修改....(本例是1us机器周期,即晶振频率要小于12MHZ)

    标签: VIIC_C I2C 程序 51

    上传时间: 2015-12-18

    上传用户:kelimu

  • 对ADO进行封装标准DLL

    对ADO进行封装标准DLL,实现C++的方式对数据库进行操作。

    标签: ADO DLL 封装标准

    上传时间: 2013-12-25

    上传用户:凤临西北

  • 一个由B/S做的宠物医院

    一个由B/S做的宠物医院,内容附带数据库文。可以直接架设使用,吐血奉贤

    标签:

    上传时间: 2015-12-28

    上传用户:671145514

  • 结合单片机和M a t l a b 两者的优点

    结合单片机和M a t l a b 两者的优点,基于事件驱动的中断通信机制,提出一种Matlab 环境下PC 机与 单片机实时串行通信及数据处理的方法;完成单片机数据采集系统与PC 机的RS-232/RS-485 串行通 信及其通信数据的分析处理、文件存储、F I R 滤波及图形显示;简化系统开发流程,提高开发效率。 该方法已成功应用于一个P I C 1 6 F 8 7 6 单片机应用系统实例之中

    标签: 单片机

    上传时间: 2014-01-19

    上传用户:yzy6007

  • < Visual C++数据库经典开发实例精解>>的实例源码

    < Visual C++数据库经典开发实例精解>>的实例源码,包括DAO,ADO,ODBC等数据库开发案例,是数据库编程入门的好帮手。

    标签: Visual gt lt 数据库

    上传时间: 2016-01-10

    上传用户:ggwz258

  • 问题描述 序列Z=<B

    问题描述 序列Z=<B,C,D,B>是序列X=<A,B,C,B,D,A,B>的子序列,相应的递增下标序列为<2,3,5,7>。 一般地,给定一个序列X=<x1,x2,…,xm>,则另一个序列Z=<z1,z2,…,zk>是X的子序列,是指存在一个严格递增的下标序列〈i1,i2,…,ik〉使得对于所有j=1,2,…,k使Z中第j个元素zj与X中第ij个元素相同。 给定2个序列X和Y,当另一序列Z既是X的子序列又是Y的子序列时,称Z是序列X和Y的公共子序列。 你的任务是:给定2个序列X、Y,求X和Y的最长公共子序列Z。

    标签: lt 序列

    上传时间: 2014-01-25

    上传用户:netwolf

  • 一个ADO数据库变程的通用类

    一个ADO数据库变程的通用类,把连接集和记录集分别用两个累封装起来。

    标签: ADO 数据库

    上传时间: 2016-01-21

    上传用户:vodssv

  • n皇后问题求解(8<=n<=1000) a) 皇后个数的设定 在指定文本框内输入皇后个数即可,注意: 皇后个数在8和1000 之间(包括8和1000) b) 求解 点击<

    n皇后问题求解(8<=n<=1000) a) 皇后个数的设定 在指定文本框内输入皇后个数即可,注意: 皇后个数在8和1000 之间(包括8和1000) b) 求解 点击<Solve>按钮即可进行求解. c) 求解过程显示 在标有Total Collision的静态文本框中将输出当前棋盘上的皇后总冲突数. 当冲突数降到0时,求解完毕. d) 求解结果显示 程序可以图形化显示8<=n<=50的皇后求解结果. e) 退出程序,点击<Exit>即可退出程序.

    标签: 1000 lt 设定 输入

    上传时间: 2016-01-28

    上传用户:ztj182002

  • 利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试

    利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试方便、故障率低、修改升级容易等特点。 本设计采用自顶向下、混合输入方式(原理图输入—顶层文件连接和VHDL语言输入—各模块程序设计)实现数字钟的设计、下载和调试。 一、 功能说明 已完成功能 1. 完成秒/分/时的依次显示并正确计数; 2. 秒/分/时各段个位满10正确进位,秒/分能做到满60向前进位; 3. 定时闹钟:实现整点报时,又扬声器发出报时声音; 4. 时间设置,也就是手动调时功能:当认为时钟不准确时,可以分别对分/时钟进行调整; 5. 利用多余两位数码管完成秒表显示:A、精度达10ms;B、可以清零;C、完成暂停 可以随时记时、暂停后记录数据。 待改进功能: 1. 闹钟只是整点报时,不能手动设置报时时间,遗憾之一; 2. 秒表不能向秒进位,也就是最多只能记时100ms; 3. 秒表暂停记录数据后不能在原有基础上继续计时,而是复位重新开始。 【注意】秒表为后来添加功能,所以有很多功能不成熟!

    标签: CPLD VHDL 芯片 时钟源

    上传时间: 2014-01-02

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