8-3编码
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大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟
大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟,数码显示,74ls138,8,4位计数器,d,rs触发器,加法器,交通灯等,此原码基于长江大学可编程器件实验箱,如要运行在其他平台上需要重新定义管脚
2013-12-23
88
向数组中输入8、7、6、5、4、3、2、1
向数组中输入8、7、6、5、4、3、2、1,对其任一元素都进行1+2+……+N计算,并将结果存入RESULT数组中,结果在屏幕上,按十进制显示出来。
2016-03-12
136
实现8比特字节的RS纠错编码
实现8比特字节的RS纠错编码,可以指定极性校验字节数目,能产生的最大校验序列长度为255字节(含极性校验字节).This is an implementation of a Reed-Solomon code with 8 bit byte...
2016-08-24
168
利用CASE语句的3-8译码器,3个为数据输入,3个为控制端,分别为S1,S2,S3,输出数据为八位
利用CASE语句的3-8译码器,3个为数据输入,3个为控制端,分别为S1,S2,S3,输出数据为八位
2017-01-23
87