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自适应滤波器的硬件实现一直是自适应信号处理领域研究的热点。随着电子技术的发展，数字系统功能越来越强大，对器件的响应速度也提出更高的要求。 本文针对用通用DSP 芯片实现的自适应滤波器处理速度低和用HDL语言编写底层代码用FPGA实现的自适应...
自适应滤波器的硬件实现一直是自适应信号处理领域研究的热点。随着电子技术的发展，数字系统功能越来越强大，对器件的响应速度也提出更高的要求。 本文针对用通用DSP 芯片实现的自适应滤波器处理速度低和用HDL语言编写底层代码用FPGA实现的自适应...
采用VHDL 语言设计，用CPLD 控制模/ 数转换电路， 完成多路模拟输入的高速同步数/ 模转换，具有容错和自检能力。CPLD 与处理器之间采用并行接口，具有很好的移植性、可靠性。
采用VHDL 语言设计，用CPLD 控制模/ 数转换电路， 完成多路模拟输入的高速同步数/ 模转换，具有容错和自检能力。CPLD 与处理器之间采用并行接口，具有很好的移植性、可靠性。
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