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本文在说明全数字锁相环的基础上，提出了一种利用FPGA设计一阶全数字锁相环的方法，并给出了关键部件的RTL可综合代码，并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程，最后对一些有关的问题...

📅 2014-01-10

用于时钟恢复的全数字锁相环设计，可以去掉时钟的抖动。...

📅 2016-05-23

一种基于锁相环的数字频率合成器的设计...

📅 2016-05-26

c8051120锁相环，定时器3的初始化和使用...

📅 2014-01-16

FPGA弹弓无线呼叫系统分发射和接收两大部分。发射部分采用锁相环式频率合成器技术...

📅 2016-05-29

这是锁相环芯片MC145170程序，单片机是用at89s52的...

📅 2013-12-18

在总结前人提出的一些锁相环仿真模型的基础上，用Matlab语言构建了一种新的适用于全数字仿真模型。...

📅 2016-06-13

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太...

📅 2016-06-14

一阶全数字锁相环VERLOGIC程序代码，调试通过。...

📅 2013-12-15

介绍了数字锁相环的3种设计方法，并对各自的工作原理做了详细分析。...

📅 2014-01-20

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