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逻辑设计

逻辑设计就是把一种计划、规划、设想通过视觉的形式通过概念、判断、推理、论证来理解和区分客观世界的思维传达出来的活动过程。逻辑设计比物理设计更理论化和抽象化,关注对象之间的逻辑关系,提供了更多系统和子系统的详细描述。
  • 实验目的 这次进行的模型机的总体设计

    实验目的 这次进行的模型机的总体设计,是在前几次实验田的基础之上进行的。前面几次实验中有算术逻辑运算单元实验,这次实验主要是完成对不带进位和带进位的加减法进行运算。这也是我们这们这次实验中的两个主要的题目。后面我们还有对通用寄存器、指令和微程序控制单元等部分的实验。而这些都是为了让我们更加了解计算机在工作时的具体运行情况,计算机在运行时,每个部分是怎样来完成自己的该完成的部分的。 这次实验主要是要我们掌握各个单元模块的工作原理,进一步将其组成完整的系统,构造一台基本的模型计算机;在本试验中,将规划读/写内存、寄存器、数值计算等功能,并且编写相应的微程序。然后具体上机调试各个模块单元以便进一步掌握整机的概念。

    标签: 实验 模型

    上传时间: 2016-08-02

    上传用户:2404

  • 本系统采用Servlet+Jsp+JavaBean+SQL2000 设计方式

    本系统采用Servlet+Jsp+JavaBean+SQL2000 设计方式,其中Servlet担当主要逻辑控制,通过接受Jsp传来的用户请求,调用以及初始化JavaBean,在通过Jsp传到客户端,本系统中SqlBean担当主要的与数据库的连接与通信,JavaBean在本系统中主要担当配合Jsp以及Servlet来完成用户的请求,而Jsp主要担当接受与响应客户端。

    标签: JavaBean Servlet 2000 Jsp

    上传时间: 2013-12-12

    上传用户:lmeeworm

  • Xilinx-ISE辅助设计工具的中文使用说明

    Xilinx-ISE辅助设计工具的中文使用说明,包括IP核生成器,布局布线器,FPGA底层编辑器,时序分析器,集成化逻辑分析工具,功率分析工具

    标签: Xilinx ISE 辅助 设计工具

    上传时间: 2014-01-18

    上传用户:zjf3110

  • 只有最初级的逻辑电路才使用单一的时钟。大多数与数据传输相关的应用都有与生俱来的挑战

    只有最初级的逻辑电路才使用单一的时钟。大多数与数据传输相关的应用都有与生俱来的挑战,即跨越多个时钟域的数据移动,本文将介绍怎样在同步设计中处理异步信号

    标签: 逻辑电路 时钟 数据传输

    上传时间: 2016-08-22

    上传用户:yyq123456789

  • LCD 因其轻薄短小,低功耗,无辐射,平面 直角显示,以及影像稳定等特点,当今应用非常 广泛。CPLD(复杂可编程逻辑器件) 是一种具有 丰富可编程功能引脚的可编程逻辑器件,不仅可 实现常规的

    LCD 因其轻薄短小,低功耗,无辐射,平面 直角显示,以及影像稳定等特点,当今应用非常 广泛。CPLD(复杂可编程逻辑器件) 是一种具有 丰富可编程功能引脚的可编程逻辑器件,不仅可 实现常规的逻辑器件功能,还可以实现复杂而独 特的时序逻辑功能。并且具有ISP (在线可编 程) [1 ] 功能,便于进行系统设计和现场对系统进 行功能修改、调试、升级。通常CPLD 芯片都有 着上万次的重写次数,即用CPLD[ 2 ] 进行硬件设 计,就像软件设计一样灵活、方便。而现今LCD 的控制大都采用专用控制芯片,且一般都采用进 口芯片,成本较高。并且为了保证在特定环境下 控制芯片能正常工作,往往要加上必需的与门、 非门、以及HC244 ,HC245 、HC373 等元件,这样 不仅提高的成本,也因分立元件的引入而降低了 电路的可靠性。本设计的目的是采用Xilinx 公 司生产的一片XC95288 和一片XC95144 来实现 LCD 控制器以及其外围控制,时序逻辑的全部 功能,使得LCD 控制系统故障率和开发成本大 大降低,并使LCD 控制系统有强大的功能可扩 展性。

    标签: CPLD LCD 可编程逻辑器件 低功耗

    上传时间: 2016-09-25

    上传用户:lanhuaying

  • 本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程

    本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程,作为我这一段 时间自学 FPGA/CPLD 的总结,如果有什么不正确的地方,敬请各位不幸看到这篇文章的 大侠们指正,在此表示感谢。当然,这是一个非常简单的时序逻辑电路实例,主要是详细 描述了一些软件的使用方法。文章中涉及的软件有Synplicity 公司出品的Synplify Pro 7.7.1; Altera 公司出品的 Quartus II 4.2;Mentor Graphics 公司出品的 ModelSim SE 6.0。

    标签: VHDL 计数器 仿真 过程

    上传时间: 2016-10-04

    上传用户:Yukiseop

  • 本系统采用Servlet+Jsp+JavaBean+SQL2000 设计方式

    本系统采用Servlet+Jsp+JavaBean+SQL2000 设计方式,其中Servlet担当主要逻辑控制,通过接受Jsp传来的用户请求,调用以及初始化JavaBean,在通过Jsp传到客户端,本系统中SqlBean担当主要的与数据库的连接与通信,JavaBean在本系统中主要担当配合Jsp以及Servlet来完成用户的请求,而Jsp主要担当接受与响应客户端。

    标签: JavaBean Servlet 2000 Jsp

    上传时间: 2013-12-18

    上传用户:zyt

  • Java Server Page Servlet简化设计

    Java Server Page Servlet简化设计,逻辑与界面设计分开,开发更方便; HTML语法的 java 扩展,加入新的标签(<%, %>,…); 强大的组件(Java Bean)支持功能;

    标签: Servlet Server Java Page

    上传时间: 2016-10-20

    上传用户:q123321

  • VHDL在CPLD和FPGA设计中的应用,期刊论文

    VHDL在CPLD和FPGA设计中的应用,期刊论文,讲述复杂逻辑器件的语言用法

    标签: VHDL CPLD FPGA 中的应用

    上传时间: 2016-10-24

    上传用户:ynsnjs

  • 飞思卡尔S12 系列单片机系统硬件设计

    飞思卡尔S12 系列单片机系统硬件设计,详细介绍了该单片机的硬件使用,为全中文,MC9S12DG128B 有16路AD 转换,精度最高可设置为10 位;有8 路8 位PWM 并可两两级联为16 位精度PWM,特别适合用于控制多电机系统。它的串行通信端口也非常丰富,有2 路SCI,2 路SPI 此外还有IIC,CAN总线等端口,并且采用了引角复用功能,使得这些功能引角也可设置为普通的IO 端口使用。此外 它内部还集成了完整的模糊逻辑指令,可大大简化我们的程序设计。

    标签: S12 飞思卡尔 单片机系统 硬件设计

    上传时间: 2013-12-18

    上传用户:anng