VIP专区-嵌入式/单片机编程源码精选合集系列（87）资源包含以下内容：1. 在nios II DE2开发板上开发的实时时钟.2. 绝对好用的M64-SD卡MP3程序.3. 实现各种算数逻辑运算 根据输入的指令不同.4. 温度测控完整开发档案。包括原理图.5. 好记星的控件,包括button,list,对文件操作.6. FPGA/CPLD VHDL语言实现SPI.7. RS232-光纤的CPLD调制解调源程序.8. 液晶显示.9. 嵌入式的简单测试程序.10. Sbc2410的原理图.11. 高质量的软件代码规范.12. 充电芯片的ORCAD原理图.13. 使用VerilogHDL语言实现硬件的开发模拟.14. 使用VerilogHDL语言实现硬件的开发模拟.15. 一个全的2410试验板的原理图核PCB图,可以直接用,适合想做开发板的新手.16. 三星公司流行的ARM芯片44b0的原理图和PCB；可以帮助有志于学习使用ARM的同事参考和使用.17. 基于51的多功能电子钟,多闹钟,温度测试.18. 2410的三星的3.5寸液晶驱动程序.19. 该程序采用C语言编写,是程序员编写菜单程序的通用典范..20. 水平直线挖掘的源程序.21. This program controls a BLDC motor in closed loop using PIC18Fxx31 devices. Hardware used is PICDE.22. 硬件I2C软件包.23. 应用matlabGUI工具设计了数据循环显示程序.24. avr祥例。 附原理图.25. NEXTCHIP的OSD开发工具,很好用的,支持256色,支持鼠标样式编辑,生成FNTFLT等格式的文件..26. 基于复杂可编程逻辑器件(CPLD)的120MHz高速A_D采集卡的设计.27. at91sama3 IAR 环境下开发的例子.28. 此软件是ARM的键盘驱动软件.29. 此软件是云台控制软件.30. *本程序四位数码管作倒计时.P0为位选,P1数码管.P3.5输出(低电平).P3.0,P3.1串口通讯..31. 单片机资料at89c2051英文板详细资料.32. 介绍一种如何用DSP和CPLD控制插补的文章.33. 最近搞的一个51开发板的原理图.34. 一种51下载线的原理图.35. 电子跑表 基于DVCC设计的电子跑表,是微机原理课程设计的题目,欢迎大家参考.36. I2C汇编程序,用于100KB/S的I2C器件运用..37. ek-stm32f开发板测试程序,LCD+LED+按键.38. ps2键盘的时序介绍和开发程序.39. 东芝机器人处理器代码,sh2有时间学习很好！.40. 时钟分频电路实现精讲(19 pages)——意法半导体.
上传时间： 2013-05-16
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Max+plusⅡ是Altera公司提供的FPGA/CPLD开发集成环境，Altera是世界上最大可编程逻辑器件的供应商之一。Max+plusⅡ界面友好，使用便捷，被誉为业界最易用易学的EDA软件。在Max+plusⅡ上可以完成设计输入、元件适配、时序仿真和功能仿真、编程下载整个流程，它提供了一种与结构无关的设计环境，是设计者能方便地进行设计输入、快速处理和器件编程。
标签： 计算机组成原理
上传时间： 2013-05-22
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现场可编程逻辑门阵列器件 FPGA原理及应用设计
上传时间： 2013-04-15
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利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点
上传时间： 2013-08-11
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可编程器件厂商Xilinx的手持式逻辑分析仪的逻辑设计，包括完整的可用于Xlinx器件的硬件code，以及用来接口的C代码
上传时间： 2013-12-17
上传用户：sy_jiadeyi
这是用AHDL语言即abel语言编写的逻辑可编程器件原代码！供大家参考！
上传时间： 2014-01-07
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TLC549是一种采用8位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、8位A/D转换器、数据寄存器以及控制逻辑电路。TLC549每25uS重复一次“输入—转换—输出”。器件有两个控制输入：I/O CLOCK和片选（CS）。 内部系统时钟和I/O CLOCK可独立使用。应用电路的设计只需利用I/O时钟启动转换或读出转换结果。当CS为高电平时，DATA OUT处于高阻态且I/O时钟被禁止。
上传时间： 2014-01-17
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LTC1446是一种采用12位逐次逼近式工作的A/D转换器。内部包含系统时钟、采样和保持、12位A/D转换器、数据寄存器以及控制逻辑电路。LTC1446每25uS重复一次“输入——转换——输出”。器件有两个控制输入：DIN CLK和片选（CS）。 内部系统时钟和DIN CLK可独立使用。应用电路的设计只需利用时钟启动转换或读出转换结果。当CS为高电平时， Dout处于高阻态且DIN时钟被禁止。
上传时间： 2014-01-23
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利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。 本设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VHDL语言输入—各模块程序设计）实现数字钟的设计、下载和调试。 一、 功能说明 已完成功能 1. 完成秒／分／时的依次显示并正确计数； 2. 秒／分／时各段个位满10正确进位，秒／分能做到满60向前进位； 3. 定时闹钟：实现整点报时，又扬声器发出报时声音； 4. 时间设置，也就是手动调时功能：当认为时钟不准确时，可以分别对分／时钟进行调整； 5. 利用多余两位数码管完成秒表显示：A、精度达10ms；B、可以清零；C、完成暂停 可以随时记时、暂停后记录数据。 待改进功能： 1. 闹钟只是整点报时，不能手动设置报时时间，遗憾之一； 2. 秒表不能向秒进位，也就是最多只能记时100ms； 3. 秒表暂停记录数据后不能在原有基础上继续计时，而是复位重新开始。 【注意】秒表为后来添加功能，所以有很多功能不成熟！
上传时间： 2014-01-02
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SOPC是Altera公司提出的一种灵活、高效的片上系统设计方案,它可以有选择地将处理器、存储器、I/O等系统设计需要的组件集成到一个PLD器件上。在SOPC设计中可方便地加入用户自定义逻辑。该文简要介绍了SOPC设计架构,然后通过一个实例,详细介绍了嵌入式系统中SOPC设计的实现方法和效果。
上传时间： 2016-07-23
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