c8051f系列单片机的SPI 并行/串行通信源程序 Cygnal出的一种混合信号系统级单片机。片内含CIP－51的CPU内核，它的指令系统与MCS－51完全兼容。其中的C8051F020单片机含有64kB片内Flash程序存储器，4352B的RAM、8个I／O端口共64根I／O口线、一个12位A／D转换器和一个8位A／D转换器以及一个双12位D／A转换器、2个比较器、5个16位通用定时器、5个捕捉／比较模块的可编程计数／定时器阵列、看门狗定时器、VDD监视器和温度传感器等部分。C8051F020单片机支持双时钟，其工作电压范围为2．7～3．6V（端口I/O,RST和JTAG引脚的耐压为5V）。与以前的51系列单片机相比，C8051F020增添了许多功能，同时其可靠性和速度也有了很大提高。
上传时间： 2013-12-24
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RS-232、RS-422与RS-485都是串行数据接口标准，最初都是由电子工业协会（EIA）制 订并发布的，RS-232在1962年发布，命名为EIA-232-E，作为工业标准，以保证不同厂家产品 之间的兼容。RS-422由RS-232发展而来，它是为弥补RS-232之不足而提出的。为改进RS-232 通信距离短、速率低的缺点，RS-422定义了一种平衡通信接口，将传输速率提高到10Mb/s， 传输距离延长到4000英尺（速率低于100kb/s时），并允许在一条平衡总线上连接最多10个接 收器
上传时间： 2017-06-14
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AT24C256是ATMEL公司256kbit串行电可擦的可编程只读存储器，8引脚双排直插式封装，具有结构紧凑、存储容量大等特点，可以在2线总线上并接4片该IC，特别适用于具有高容量数据储存要求的数据采集系统。本文将介绍该IC的工作原理和与单片机的软硬件接口。
上传时间： 2017-07-05
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泰克公司的非常好的技术资料，包括高速串行总线设计规范，信号采集和分析概念，测试方案等
上传时间： 2020-02-23
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说明：Microchip Technology Inc.采用存储容量为1 Kb至1Mb的低电压串行电可擦除PROM（Electrically Erasable PROM，EEPROM），支持兼容串行外设接口（Serial Peripheral Interface，SPI）的串行总线架构，该系列器件支持字节级和页级功能，存储容量为512 Kb和1Mb的器件还通常与基于闪存的产品结合使用，具有扇区和芯片擦除功能。所需的总线信号为时钟输入（SCK）线、独立的数据输入（S1）线和数据输出（SO）线。通过片选（CS）输入信号控制对器件的访问。可通过保持引脚（HOLD）暂停与器件的通信。器件被暂停后，除片选信号外的所有输入信号的变化都将被忽略，允许主机响应优先级更高的中断。整个SPI兼容系列器件都具有标准的8引脚PDIP和SOIC封装，以及更高级的封装，如8引脚TSSOP，MSOP.2x3DFN，5x6 DFN和6引脚SOT-23封装形式。所有封装均为符合RoHS标准的无铅（雾锡）封装。引脚图（未按比例绘制）
上传时间： 2022-06-20
上传用户：fliang
摘要：随着工业自动化的发展，PLC与计算机在工业中的应用越来越广泛，为了充分发挥它们的各自优越性，PIC与个人计算机间的通讯越来越频繁。本文以QMRON小型PLC CPIH为例，介绍了如何用vB编程软件实现上位机和PLC的串行通讯。该方案具有硬件简单，使用灵活的特点。对中小型控制系统实现人机界面有一定的参考价值。关健词：Visual Basic 6.0；可编程控制器；串行通讯随着工业控制要求的不断发展，上位机监控已基本成为集散控制系统所不可缺少的部分。一般情况下，在大型的集散控制系统中都是用专业工控组态软件制作上位机的监控界面，而以PLC厂家所推荐的DDE SERVER作为联系上位机和PLC的桥梁。操作员站采用工控组态软件实现画面监控。由于这种方案成本较高，所以在很多小型的集散控制系统中，趋向于采用通用工程软件，如DELPHI，VISUAL BASIC，VISUAL C++等编制上位机监控界面。同时，在一些实时性要求较高的监控应用中，用VISUALBASIC等工具可实现更底层的控制，在硬件配置相同时系统响应比工控组态软件要快。
上传时间： 2022-06-26
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SERDES是英文SERializer(串行器)/DESerializer(解串器)的简称。它是一种时分多路复用(TDM)、点对点的通信技术，即在发送端多路低速并行信号被转换成高速串行信号，经过传输媒体(光缆或铜线)，最后在接收端高速串行信号重新转换成低速并行信号。这种点对点的串行通信技术充分利用传输媒体的信道容量，减少所需的传输信道和器件引脚数目，从而大大降低通信成本。随着对信息流量需求的不断增长，传统并行接口技术成为进一步提高数据传输速率的瓶颈。过去主要用于光纤通信的串行通信技术——SERDES正在取代传统并行总线而成为高速接口技术的主流。本文阐述了介绍SERDES的架构、关键技术、SERDES硬件设计要点以及测试方法。
上传时间： 2022-06-30
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基于USB的串行通信软硬件设计
上传时间： 2013-08-04
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专辑类-数字处理及显示技术专辑-106册-9138M 基于USB的串行通信软硬件设计-41页-0.8M.pdf
上传时间： 2013-07-19
上传用户：yatouzi118
现代社会信息量爆炸式增长，由于网络、多媒体等新技术的发展，用户对带宽和速度的需求快速增加。并行传输技术由于时钟抖动和偏移，以及PCB布线的困难，使得传输速率的进一步提升面临设计的极限；而高速串行通信技术凭借其带宽大、抗干扰性强和接口简单等优势，正迅速取代传统的并行技术，成为业界的主流。 本论文针对目前比较流行并且有很大发展潜力的两种高速串行接口电路——高速链路口和Rocket I/O进行研究，并以Xilinx公司最新款的Virtex-5 FPGA为研究平台进行仿真设计。本论文的主要工作是以某低成本相控阵雷达信号处理机为设计平台，在其中的一块信号处理板上，进行了基于LVDS(Low VoltageDifferential Signal)技术的高速LinkPort(链路口)设计和基于CML(Current ModeLogic)技术的Rocket I/O高速串行接口设计。首先在FPGA的软件中进行程序设计和功能、时序的仿真，当仿真验证通过之后，重点是在硬件平台上进行调试。硬件调试验证的方法是将DSP TS201的链路口功能与在FPGA中的模拟高速链路口相连接，进行数据的互相传送，接收和发送的数据相同，证明了高速链路口设计的正确性。并且在硬件调试时对Rocket IO GTP收发器进行回环设计，经过回环之后接收到的数据与发送的数据相同，证明了Rocket I/O高速串行接口设计的正确性。
上传时间： 2013-04-24
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