嵌入式网络视频监控系统是一种以嵌入式技术、视频编码技术和网络传输技术为核心的新型视频监控系统，它在稳定性、实时性、处理速度、功能、价格、扩展性等方面和传统的视频监控系统相比有着突出的优势，同时也代表着目前视频监控系统研究和发展的方向。 本文研究并实现了以微处理器S3C2440和嵌入式Linux操作系统为核心的嵌入式网络视频监控系统。论文首先介绍了嵌入式视频监控技术的发展趋势和研究现状，而后阐述了该系统硬件总体设计方案，讨论了基于嵌入式Linux操作系统的开发平台的构建，详细论述了视频采集、编码、存储、传输等单元的软硬件设计，重点论述了基于AL9V576的视频编码模块和基于TW2835的视频处理模块的设计。 本文研究的主要内容如下： 1、研究视频采集单元的优化方法，设计采用音视频控制器TW2835采集四路模拟视频输入信号并叠加OSD环境信息显示，提高了视频处理的功能和视频质量； 2、研究双核构架，采用混合信号系统级芯片C8051F340控制TW2835、采集环境信息并与S3C2440串口通信，使视频采集单元模块化设计，增加了产品设计的灵活性，减小了主控芯片的负担和软件设计的复杂性，便于产品功能的扩展和二次开发； 3、研究并分析了MPEG-4的硬件实现方式，采用高品质、高性能、低功率视频压缩芯片AL9V576进行MPEG-4编码，大幅提升了压缩效率，另外还设计了SRAM主机接口与主控芯片通信，突破了传统芯片大多采用的PCI接口的限制，方便模块的组合； 4、研究并设计了CF卡存储方案，实现了一种在嵌入式视频服务器上的视频检索和存储方法。
上传时间： 2013-05-16
上传用户：cuicuicui
远程抄表技术是将数据远程采集、传输和处理应用于自来水、电力、天燃气(以下简称水、电、气)供应与管理系统中的一项新技术。传统的远程抄表，无线系统一般用于数据处理中心和数据通信中心的远程通讯，在表和数据通讯中心的短距离通信一般使用有线通讯。如今以ARM处理器作为主CPU的嵌入式硬件平台，一方面，它具有体积小、性能强、功耗低、可靠性高等特点，另一方面，它为高速、稳定地运行嵌入式操作系统提供了硬件基础。无线射频通讯成本低，可靠性好，环境适应能力强，本文就对基于ARM的射频无线抄表系统的开发进行了研究。 本文主要对以下五个方面的技术进行了研究：一是介绍了远程抄表的背景和意义。二是介绍了国内外广泛使用的几种典型的远程抄表系统的原理及其系统组成，分析了各种远程抄表系统的优、缺点以及适用范围；三是基于课题的需要，介绍了嵌入式系统。四是搭建基于ARM的硬件平台。硬件平台设计以三星公司的ARM920T核的S3C2440A为微处理器，根据系统要求完成S3C2440A外围器件的设计，包括64M NAND Flash、64MSDRAM、SD卡以及USB，串口通信的电路设计，射频无线通讯和视频采集的设计。五是对Windows CE操作系统的移植。平台移植过程中Boot Loader开发，OAL层修改，串口和LCD驱动程序的开发，内核的定制过程。在应用程序开发中，PB中导出SDK的过程以及EVC应用程序的调试，对数据库进行了开发。最后，指出了本远程自动抄表系统中有待完善的地方以及抄表技术今后的发展趋势。
上传时间： 2013-06-26
上传用户：kelimu
本文根据大楼电梯视频监控系统的要求，提出了一种基于嵌入式技术的网络视频监控系统实现方案。系统以嵌入式Linux和嵌入式微处理器S3C2410X为核心平台，通过嵌入式平台建立的基于TCP/IP协议的视频服务器，将USB摄像头采集来的图像数据压缩后，经过网络传输，完成对监控现场的网络视频监控任务。首先阐述了嵌入式网络视频监控系统的发展、现状以及整体构建，然后介绍了嵌入式Linux操作系统以及ARM处理器的发展情况，分析了主要外围电路的设计，以及如何在ARM硬件平台上进行嵌入式Linux内核的编译与移植，介绍了Bootloader的启动原理及运行过程，并对在Linux操作系统下的USB驱动程序的开发进行了研究。本文重点讨论了图像采集、编码和网络通信程序的设计原理与实现。最后进行了系统整体测试，并提出了进一步开发设想。
上传时间： 2013-06-15
上传用户：17854267178
远程监控系统是许多重要场所诸如电力、邮电、银行、交通、商场等需要信息广泛交流企业的生产与管理的必备系统。传统远程监控系统的实现方式一般都需要自己建设并维护有线或无线网络，维护费用高，通信距离有限。随着通信技术的发展，原有的远程监控系统已经日益不能满足多方面的要求，我们需要实时性更高，通信距离更远，成本更低的通信方式，本文就此提出了一种基于GPRS的远程数据监控系统。 本文的创新点是采用了GPRS技术中的TCP传输方式来传输监控系统采集的图像数据，相比传统有线网络，在维护成本，通信距离上有了很大的提高，相比传统无线网络在实时性，传输速率，可靠性上有了明显的改善。 本论文分几个部分详细介绍了课题的研究内容。第一部分主要介绍了课题背景和监控系统的发展历史及各类监控系统的比较。第二部分描述了本监控系统中远程终端硬件系统搭建工作，包括各部分器件的选取以及在S3C4480为核心的开发板上扩展出LM9617接口。第三部分描述了以uC/OS操作系统为核心的远程终端软件设计流程，包括uC/OS操作系统和FAT16文件系统的移植，LCD显示驱动， Nand-flash底层驱动的编写等工作。第四部分详细说明了本系统图像采集的具体软件实现，包括根据实际情况配置CMOS图像传感器LM9617的寄存器以及从LM9617中读取图像数据然后将数据写入Nand-flash存储器的具体过程。第五部分详细说明了本系统图像数据传输的具体软件实现，采用的是GPRS企业公网组网方式，包括远程终端程序设计和监控中心服务器搭建两部分工作。远程终端程序设计包括初始化串口通信，将Nand-flash中的图像数据读出并通过GPRS模块GM862发送到监控中心服务器上；监控中心服务器程序设计包括启动建立并启动Socket监听，以及收到连接请求后GPRS通信链路的建立。最后分别用TCP和UDP两种传输方式对监控系统进行了测试，证明了GPRS的TCP传输方式确实更适合于监控系统。
上传时间： 2013-07-19
上传用户：liuwei6419
随着计算机和集成电路技术的不断发展,基于EDA技术的芯片设计正在成为电子系统设计的主流.现场可编程门阵列(FPGA)作为一种可编程专用集成电路(ASIC)已经广泛应用于计算机、通信、航空航天等各个领域.一般来讲,FPGA多用于高速通信和高速信号处理领域,以发挥其处理速度快的特点,本文将其应用于一低速低功耗系统——某水下远程遥控接收系统,主要用其在频域来实现水下远程遥控的解码,取得了令人满意的效果.该文主要做了以下几方面的工作.首先,深入研究和分析了在频域实现水下远程遥控解码的原理并进行了遥控指令编码设计;其次,用ALTERA公司的CYCLONE系列FPGA芯片完成了水下远程遥控FPGA解码芯片的设计工作,包括硬件描述语言(VHDL)编码、电路前后仿真、综合和布局布线工作,并对设计的FPGA解码芯片进行了初步的功耗估算:最后设计制作了一块FPGA解码芯片电路验证测试板,并完成了电路调试和测试.实验测试结果表明,用FPGA实现水下远程遥控解码电路的方案是可行的,可以有效地缩小系统体积、提高系统可靠性,在保证系统性能情况下做到更低的功耗,还可以实现在系统配置和编程,使得系统的调试、升级和维护更加灵活方便.
上传时间： 2013-06-03
上传用户：zoushuiqi
ASIC对产品成本和灵活性有一定的要求.基于MCU方式的ASIC具有较高的灵活性和较低的成本,然而抗干扰性和可靠性相对较低,运算速度也受到限制.常规ASIC的硬件具有速度优势和较高的可靠性及抗干扰能力,然而不是灵活性较差,就是成本较高.与传统硬件(CHW)相比,具有一定可配置特性的场可编程门阵列(FPGA)的出现,使建立在可再配置硬件基础上的进化硬件(EHW)成为智能硬件电路设计的一种新方法.作为进化算法和可编程器件技术相结合的产物,可重构FPGA的研究属于EHW的研究范畴,是研究EHW的一种具体的实现方法.论文认为面向分类的专用类可重构FPGA(ASR-FPGA)的研究,可使可重构电路粒度划分的针对性更强、设计更易实现.论文研究的可重构FPGA的BCH通讯纠错码进化电路是一类ASR-FPGA电路的具体方法,具有一定的实用价值.论文所做的工作主要包括:(1)BCH编译码电路的设计——求取实验用BCH码的生成多项式和校验多项式及其相应的矩阵并构造实验用BCH码;(2)建立基于可重构FPGA的基核——构造具有可重构特性的硬件功能单元,以此作为可重构BCH码电路的设计基础;(3)构造实现可重构BCH纠错码电路的方法——建立可重构纠错码硬件电路算法并进行实验验证;(4)在可重构纠错码电路基础上,构造进化硬件控制功能块的结构,完成各进化RLA控制模块的验证和实现.课题是将可重构BCH码的编译码电路的实现作为一类ASR-FPGA的研究目标,主要成果是根据可编程逻辑电路的特点,选择一种可编程树的电路模型,并将它作为可重构FPGA电路的基核T;通过对循环BCH纠错码的构造原理和电路结构的研究,将基核模型扩展为能满足纠错码电路需要的纠错码基本功能单元T;以T作为再划分的基本单元,对FPGA进行"格式化",使T规则排列在FPGA上,通过对T的控制端的不同配置来实现纠错码的各个功能单元;在可重构基核的基础上提出了纠错码重构电路的嵌套式GA理论模型,将嵌套式GA的染色体串作为进化硬件描述语言,通过转换为相应的VHDL语言描述以实现硬件电路;采用RLA模型的有限状态机FSM方式实现了可重构纠错码电路的EHW的各个控制功能块.在实验方面,利用Xilinx FPGA开发系统中的VHDL语言和电路图相结合的设计方法建立了循环纠错码基核单元的可重构模型,进行循环纠错BCH码的电路和功能仿真,在Xilinx公司的Virtex600E芯片进行了FPGA实现.课题在研究模型上选取的是比较基本的BCH纠错码电路,立足于解决基于可重构FPGA核的设计的基本问题.课题的研究成果及其总结的一套ASR-FPGA进化硬件电路的设计方法对实际的进化硬件设计具有一定的实际指导意义,提出的基于专用类基核FPGA电路结构的研究方法为新型进化硬件的器件结构的设计也可提供一种借鉴.
上传时间： 2013-07-01
上传用户：myworkpost
MSP430系列flash型超低功耗16位单片机MSP430系列单片机在超低功耗和功能集成等方面有明显的特点。该系列单片机自问世以来，颇受用户关注。在2000年该系列单片机又出现了几个FLASH型的成员，它们除了仍然具备适合应用在自动信号采集系统、电池供电便携式装置、超长时间连续工作的设备等领域的特点外，更具有开发方便、可以现场编程等优点。这些技术特点正是应用工程师特别感兴趣的。《MSP430系列FLASH型超低功耗16位单片机》对该系列单片机的FLASH型成员的原理、结构、内部各功能模块及开发方法与工具作详细介绍。MSP430系列FLASH型超低功耗16位单片机 目录 第1章 引 论1.1 MSP430系列单片机1.2 MSP430F11x系列1.3 MSP430F11x1系列1.4 MSP430F13x系列1.5 MSP430F14x系列第2章 结构概述2.1 引 言2.2 CPU2.3 程序存储器2.4 数据存储器2.5 运行控制2.6 外围模块2.7 振荡器与时钟发生器第3章 系统复位、中断及工作模式3.1 系统复位和初始化3.1.1 引 言3.1.2 系统复位后的设备初始化3.2 中断系统结构3.3 MSP430 中断优先级3.3.1 中断操作--复位/NMI3.3.2 中断操作--振荡器失效控制3.4 中断处理 3.4.1 SFR中的中断控制位3.4.2 中断向量地址3.4.3 外部中断3.5 工作模式3.5.1 低功耗模式0、1（LPM0和LPM1）3.5.2 低功耗模式2、3（LPM2和LPM3）3.5.3 低功耗模式4（LPM4）22 3.6 低功耗应用的要点23第4章 存储空间4.1 引 言4.2 存储器中的数据4.3 片内ROM组织4.3.1 ROM 表的处理4.3.2 计算分支跳转和子程序调用4.4 RAM 和外围模块组织4.4.1 RAM4.4.2 外围模块--地址定位4.4.3 外围模块--SFR4.5 FLASH存储器4.5.1 FLASH存储器的组织4.5.2 FALSH存储器的数据结构4.5.3 FLASH存储器的控制寄存器4.5.4 FLASH存储器的安全键值与中断4.5.5 经JTAG接口访问FLASH存储器39第5章 16位CPU5.1 CPU寄存器5.1.1 程序计数器PC5.1.2 系统堆栈指针SP5.1.3 状态寄存器SR5.1.4 常数发生寄存器CG1和CG25.2 寻址模式5.2.1 寄存器模式5.2.2 变址模式5.2.3 符号模式5.2.4 绝对模式5.2.5 间接模式5.2.6 间接增量模式5.2.7 立即模式5.2.8 指令的时钟周期与长度5.3 指令组概述5.3.1 双操作数指令5.3.2 单操作数指令5.3.3 条件跳转5.3.4 模拟指令的简短格式5.3.5 其他指令第6章 硬件乘法器6.1 硬件乘法器6.2 硬件乘法器操作6.2.1 无符号数相乘(16位×16位、16位×8位、8位×16位、8位×8位)6.2.2 有符号数相乘(16位×16位、16位×8位、8位×16位、8位×8位)6.2.3 无符号数乘加(16位×16位、16位×8位、8位×16位、8位×8位)6.2.4 有符号数乘加(16位×16位、16位×8位、8位×16位、8位×8位)6.3 硬件乘法器寄存器6.4 硬件乘法器的软件限制6.4.1 寻址模式6.4.2 中断程序6.4.3 MACS第7章 基础时钟模块7.1 基础时钟模块7.2 LFXT1与XT27.2.1 LFXT1振荡器7.2.2 XT2振荡器7.2.3 振荡器失效检测7.2.4 XT振荡器失效时的DCO7.3 DCO振荡器7.3.1 DCO振荡器的特性7.3.2 DCO调整器7.4 时钟与运行模式7.4.1 由PUC启动7.4.2 基础时钟调整7.4.3 用于低功耗的基础时钟特性7.4.4 选择晶振产生MCLK7.4.5 时钟信号的同步7.5 基础时钟模块控制寄存器7.5.1 DCO时钟频率控制7.5.2 振荡器与时钟控制寄存器7.5.3 SFR控制位第8章 输入输出端口8.1 引 言8.2 端口P1、P28.2.1 P1、P2的控制寄存器8.2.2 P1、P2的原理8.2.3 P1、P2的中断控制功能8.3 端口P3、P4、P5和P68.3.1 端口P3、P4、P5和P6的控制寄存器8.3.2 端口P3、P4、P5和P6的端口逻辑第9章 看门狗定时器WDT9.1 看门狗定时器9.2 WDT寄存器9.3 WDT中断控制功能9.4 WDT操作第10章 16位定时器Timer_A10.1 引 言10.2 Timer_A的操作10.2.1 定时器模式控制10.2.2 时钟源选择和分频10.2.3 定时器启动10.3 定时器模式10.3.1 停止模式10.3.2 增计数模式10.3.3 连续模式10.3.4 增/减计数模式10.4 捕获/比较模块10.4.1 捕获模式10.4.2 比较模式10.5 输出单元10.5.1 输出模式10.5.2 输出控制模块10.5.3 输出举例10.6 Timer_A的寄存器10.6.1 Timer_A控制寄存器TACTL10.6.2 Timer_A寄存器TAR10.6.3 捕获/比较控制寄存器CCTLx10.6.4 Timer_A中断向量寄存器10.7 Timer_A的UART应用 第11章 16位定时器Timer_B11.1 引 言11.2 Timer_B的操作11.2.1 定时器长度11.2.2 定时器模式控制11.2.3 时钟源选择和分频11.2.4 定时器启动11.3 定时器模式11.3.1 停止模式11.3.2 增计数模式11.3.3 连续模式11.3.4 增/减计数模式11.4 捕获/比较模块11.4.1 捕获模式11.4.2 比较模式11.5 输出单元11.5.1 输出模式11.5.2 输出控制模块11.5.3 输出举例11.6 Timer_B的寄存器11.6.1 Timer_B控制寄存器TBCTL11.6.2 Timer_B寄存器TBR11.6.3 捕获/比较控制寄存器CCTLx11.6.4 Timer_B中断向量寄存器第12章 USART通信模块的UART功能12.1 异步模式12.1.1 异步帧格式12.1.2 异步通信的波特率发生器12.1.3 异步通信格式12.1.4 线路空闲多机模式12.1.5 地址位多机通信格式12.2 中断和中断允许12.2.1 USART接收允许12.2.2 USART发送允许12.2.3 USART接收中断操作12.2.4 USART发送中断操作12.3 控制和状态寄存器12.3.1 USART控制寄存器UCTL12.3.2 发送控制寄存器UTCTL12.3.3 接收控制寄存器URCTL12.3.4 波特率选择和调整控制寄存器12.3.5 USART接收数据缓存URXBUF12.3.6 USART发送数据缓存UTXBUF12.4 UART模式，低功耗模式应用特性12.4.1 由UART帧启动接收操作12.4.2 时钟频率的充分利用与UART的波特率12.4.3 多处理机模式对节约MSP430资源的支持12.5 波特率计算 第13章 USART通信模块的SPI功能13.1 USART同步操作13.1.1 SPI模式中的主模式13.1.2 SPI模式中的从模式13.2 中断与控制功能 13.2.1 USART接收/发送允许位及接收操作13.2.2 USART接收/发送允许位及发送操作13.2.3 USART接收中断操作13.2.4 USART发送中断操作13.3 控制与状态寄存器13.3.1 USART控制寄存器13.3.2 发送控制寄存器UTCTL13.3.3 接收控制寄存器URCTL13.3.4 波特率选择和调制控制寄存器13.3.5 USART接收数据缓存URXBUF13.3.6 USART发送数据缓存UTXBUF第14章 比较器Comparator_A14.1 概 述14.2 比较器A原理14.2.1 输入模拟开关14.2.2 输入多路切换14.2.3 比较器14.2.4 输出滤波器14.2.5 参考电平发生器14.2.6 比较器A中断电路14.3 比较器A控制寄存器14.3.1 控制寄存器CACTL114.3.2 控制寄存器CACTL214.3.3 端口禁止寄存器CAPD14.4 比较器A应用14.4.1 模拟信号在数字端口的输入14.4.2 比较器A测量电阻元件14.4.3 两个独立电阻元件的测量系统14.4.4 比较器A检测电流或电压14.4.5 比较器A测量电流或电压14.4.6 测量比较器A的偏压14.4.7 比较器A的偏压补偿14.4.8 增加比较器A的回差第15章 模数转换器ADC1215.1 概 述15.2 ADC12的工作原理及操作15.2.1 ADC内核15.2.2 参考电平15.3 模拟输入与多路切换15.3.1 模拟多路切换15.3.2 输入信号15.3.3 热敏二极管的使用15.4 转换存储15.5 转换模式15.5.1 单通道单次转换模式15.5.2 序列通道单次转换模式15.5.3 单通道重复转换模式15.5.4 序列通道重复转换模式15.5.5 转换模式之间的切换15.5.6 低功耗15.6 转换时钟与转换速度15.7 采 样15.7.1 采样操作15.7.2 采样信号输入选择15.7.3 采样模式15.7.4 MSC位的使用15.7.5 采样时序15.8 ADC12控制寄存器15.8.1 控制寄存器ADC12CTL0和ADC12CTL115.8.2 转换存储寄存器ADC12MEMx15.8.3 控制寄存器ADC12MCTLx15.8.4 中断标志寄存器ADC12IFG.x和中断允许寄存器ADC12IEN.x15.8.5 中断向量寄存器ADC12IV15.9 ADC12接地与降噪第16章 FLASH型芯片的开发16.1 开发系统概述16.1.1 开发技术16.1.2 MSP430系列的开发16.1.3 MSP430F系列的开发16.2 FLASH型的FET开发方法16.2.1 MSP430芯片的JTAG接口16.2.2 FLASH型仿真工具16.3 FLASH型的BOOT ROM16.3.1 标准复位过程和进入BSL过程16.3.2 BSL的UART协议16.3.3 数据格式16.3.4 退出BSL16.3.5 保护口令16.3.6 BSL的内部设置和资源附录A 寻址空间附录B 指令说明B.1 指令汇总B.2 指令格式B.3 不增加ROM开销的模拟指令B.4 指令说明（字母顺序）B.5 用几条指令模拟的宏指令附录C MSP430系列单片机参数表附录D MSP430系列单片机封装形式附录E MSP430系列器件命名
上传时间： 2014-04-28
上传用户：sssnaxie
针对高校实验教学的现状以及存在的问题，提出了基于Struts的网络实验教学平台。设计这样一个教学平台其主要目的也是在帮助学生完成对知识的建构，同时也必需要考虑相应的教学目标以及教学策略的运用。该平台采用C/S局域网，把实验教学系统放在服务器端，让学生通过浏览器来访问，软件使用MVC模式。平台整合了现有的实验资源，通过实验预约排课等模块辅助实验室管理员的日常管理工作，帮助实验教学顺利有效的开展，实现学生的个性化学习，实现以人为本的教育理念；同时促进了教育信息化的发展，有利于培养学生的综合素质。
上传时间： 2013-11-10
上传用户：zczc
随着计算机技术的不断发展，使得现代教育教学思想发生了转变，在教学过程中对计算机的使用越来越多，计算机辅助教学系统也随之产生。对于考试而言，试题库自动组卷系统的产生使考试的发展适应了科学化、标准化的要求。试题库系统以计算机辅助教学平台为基础，逐步受到教育界的重视。在试题库系统的开发过程中，其主要功能之一就是自动组卷，实现教育的自动化。但由于试题库的建立没有一个标准，各高校独自研发自己的试题库，组卷的质量和效率存在较大差异，很难推广。为解决这一问题，本文主要基于SOA技术建立试题库自动组卷系统。
上传时间： 2013-10-15
上传用户：truth12
介绍了远程抄表系统终端的硬件结构与软件流程设计，STC89C52单片机作为主控单元，TC35i作为GSM通信模块，实现电表数据的采集和远程无线传输。该系统具有成本低廉，运行高效可靠的特点，可实现远程抄表要求，解决了人工抄表效率低，准确率低的问题，具有巨大的市场发展潜力。
上传时间： 2013-10-15
上传用户：RQB123
