缓速器

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针对传统数字信号处理器件速度上的瓶颈问题,提出了一种基于FPGA 的快速中值滤波器设计方 法,阐述了快速中值滤波器的硬件构架设计和寄存器传输级代码的实现,对整个系统进行了仿真,并对结果 进行了分析说明。

2025-06-23 7 缓速器

高速乘法器ad835模块pCb图,原理图就是pdf资料上提供的,在pcb布局上比较紧凑,经实验验证,用该电路模块实现的乘法器混频效果较好,可以实现对本振信号,输入信号的抑制比达到40dB

2023-03-13 3 缓速器