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FPGA全局时钟约束(Xilinx)...

📅 2013-11-13 👤 农药锋6

Xilinx FPGA 全局时钟约束

cadence16.5基本规则设置。...

📅 2013-12-26 👤 王成林。

cadence 16.5 基本规则

    针对目前导航系统中重要的多约束条件下路径规划功能，结合A*算法和蚁群算法提出一种新的不确定算法，该算法首先将多约束条件进行融合使其适合蚁群转移，并在基本蚁群算法基础上采用了A*算法的评估指标，为蚁群转移时提供最优预测收敛点。通过实验证明该算法可以大幅度降低时...

📅 2013-11-01 👤 qwer0574

多约束条件下路径规划算法研究

altium designer 6.9 设计规则，详细的介绍了使用altium designer 6.9版本的原理图和PCB 布线规则，使用altium designer 必读的资料...

📅 2013-11-02 👤 jjj0202

designer altium 6.9

protel_dxp规则设置...

📅 2013-11-01 👤 432234

protel_dxp

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