搜索:时钟校对
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https://www.eeworm.com/dl/994202.html
技术资料
c51可校准的时钟
探索这款基于C51单片机精心打造的可校准时钟项目,它不仅展示了基础时钟功能,还特别加入了时间校准特性,非常适合嵌入式系统初学者和爱好者深入研究。通过动手实践这一难得一见的完整案例,你将能够掌握单片机编程中的关键概念和技术细节。 ...
https://www.eeworm.com/dl/663/305649.html
VHDL/FPGA/Verilog
本程序为模拟可校时的时钟程序;clk--时钟信号,rst--清零信号,set_en--校时 使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校 时
本程序为模拟可校时的时钟程序;clk--时钟信号,rst--清零信号,set_en--校时
使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校
时,(hh,hl,ml,mh,sh,sl)--时,分,秒显示信号。
校时的时候,秒清零。
https://www.eeworm.com/dl/663/337034.html
VHDL/FPGA/Verilog
基于bcd码校时的数字钟
基于bcd码校时的数字钟,带闹钟,正点报时,和日历功能
https://www.eeworm.com/dl/663/163110.html
VHDL/FPGA/Verilog
使用Verilog语言编写的数字钟程序.有慢校时,快校时,闹钟等功能.
使用Verilog语言编写的数字钟程序.有慢校时,快校时,闹钟等功能.
https://www.eeworm.com/dl/534/243907.html
其他
网络对时就是从Internet上获得准确的时间,以此来校对本地计算机时钟
网络对时就是从Internet上获得准确的时间,以此来校对本地计算机时钟
https://www.eeworm.com/dl/663/337033.html
VHDL/FPGA/Verilog
两个按键控制校时的VHDL时钟源码
两个按键控制校时的VHDL时钟源码,带定时闹钟和日历功能
https://www.eeworm.com/dl/639/335291.html
文件格式
1. 24小时制时间显示。 2. 可随时进行时间校对。 3. 整点报时。 4. 闹钟功能。
1. 24小时制时间显示。
2. 可随时进行时间校对。
3. 整点报时。
4. 闹钟功能。