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数字锁相环DPLL源程序,用cpld编写,展开后文件比较多,大家请耐心使用。谢谢,多多支持
数字锁相环实现源码,有很大的参考价值。 由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成.
本人写的数字锁相环,有模拟数据,学习锁相环很好的材料。参考书“数字锁相环路原理与应用”编写。
FPGA实现全数字锁相环,利用硬件描述评议verilog HDL,顶层文件DPLL.V
用FPGA实现数字锁相环,开发环境为ISE
实现了数字锁的算法,程序十分可靠,欢迎大家下载
很好的全数字锁相环源程序,大家有需要的可以看看
用FPGA实现数字锁相环,例程源码,欢迎下载使用!
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