H.264/AVC是由ITU和ISO两大组织联合组成的JVT共同制定的一项新的视频压缩技术标准，在较低带宽上提供高质量的图像传输是H.264/AVC的应用亮点。在同样的视觉质量前提下，H.264/AVC比H.263和MPEG-4节约了50％的码率。但H.264获得优越性能的代价是计算复杂度的增加，据估计其编码的计算复杂度大约为H.263的3倍，因此很难应用于实时视频处理领域。针对这一现状，业内做了大量的研究工作，力图降低其计算复杂度和提高运行效率。比如在运动估计方面，国内外在这方面的研究已经很成熟。而针对帧内/帧间预测编码的研究却较少。因此研究预测模式的快速算法具有理论意义和应用价值。 本文在详细研究H.264标准视频压缩编码特点基础上，分析了H.264帧内编码, 帧间编码及变换，量化技术的原理及特点，提出了一种基于局部边缘方向信息的快速帧内模式判决算法，通过结合SAD的模式选择方法来减少模式选择数目。它采用了Sobel梯度算子计算当前块的边缘信息，累加当前块中属于同一方向像素点的边缘矢量构造不同模式下的边缘方向直方图，以便确定最可能的预测模式。该算法有效降低了编码器的运算复杂度，在并未显著降低编码性能的情况下提升了编码器效率。仿真表明：Foreman 图像序列编码性能有了提高，其中PSNR平均降低了0.06dB，Bitrate平均降低了19.4％，这大大提高了视频传输的质量。 另外在帧间预测模式选择算法方面进行了改进研究：按顺序对不同类型进行判决，有选择地去比较可能模式，使得在有效减少需判决的模式数量的同时，结合小块模式搜索中途停止准则来确定最优模式。仿真表明：改进算法相对与原来算法能够节省很多的编码时间（平均下降了49.3％），但带来的图像质星的下降（平均下降0.08dB,可以忽略）和码率较少的增加。 同时在整数DCT变换模块中，提出了一种快速蝶形算法，使得对4×4点数据做一次变换，只需通过8×8次加法和2×8次移位运算便可完成，与原来12×8次加法和4×8次移位相比，新算法大大降低了运算复杂度。 最后介绍FPGA的特点及设计流程，并实现了H.264编解码器中变换编码及量化和熵解码模块的硬件。这种基于FPGA所实现的H.264编码视频处理模块设计具备了成本低，周期短，设计方法灵活等优点，具有广阔的市场应用前景。 仿真表明，通过使用本文提出的帧内/帧间速算法方法可使得H.264编码速度获得显著的提高，使H.264 Baseline编码器能在PC平台上实现实时编码。
上传时间： 2013-07-18
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全数字调制解调技术具有多速率、多制式、智能性等特点，这极大的提高了通信系统的灵活性和通用性，符合未来通信技术发展的方向。 本文从如下几个方面对全数字调制解调器进行了深入系统研究：1，在介绍全数字调制解调器的发展现状和研究QPSK通信调制解调方式的基础上，依据软件定性仿真分析了QPSK正交调制解调系统，设计出了满足系统要求的实现电路框图并选定了芯片；2，在完成了基于FPGA芯片实现QPSK调制解调的算法方案设计基础上，利用VHDL语言完成了芯片程序的设计，并对其进行了调试和功能仿真；3，利用设计出的调制解调器与选定的AD、DA、正交调制解调芯片，完成了QPSK通信系统的硬件电路的设计并完成了调制电路的研制；4，完成电路的信息速率大于300Kbps，产生的中频信号中心频率70MHz，带宽500KHz，满足系统设计要求，由于时间关系解调电路仍在调试中。 本文基于FPGA实现的QPSK数字调制解调器具有体积小、集成度高和软件可升级等优点，这为设计高集成和高灵活性的通信系统提供了技术基础。
上传时间： 2013-07-08
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本文介绍了一种基于AVR 单片机Atmel 169，与旋转编码器AS5040 及3966 控制直流电机构成的电风扇360 度内摇头角度调节装置的实现，设计了AS5040 旋转编码器接口电路、P
上传时间： 2013-05-19
上传用户：cath
基于单片机实现遥控编码器PT2262的软件解码
上传时间： 2013-06-26
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这篇论文在系统分析国内外雷达伺服控制系统研究现状的基础上，选定以ARM为内核的基于ARM+FPGA的雷达伺服控制器为研究对象。 首先，根据雷达伺服控制系统功能要求与性能指标，进行系统的硬件设计：选择基于ARM920T的S3C2410和Altera公司的FPGA芯片EP1C12Q240作为主控芯片，ARM与FPGA的连接形式采用中断+存储器的形式；将ARM与FPGA上多余的引脚引出作为将来升级的需要；还画出ARM+FPGA的雷达伺服控制器的系统图并制作了PCB板。 其次，选用PID对伺服系统进行控制，模糊神经网络综合了模糊控制和神经网络的优点，并利用模糊神经网络算法对PID参数进行在线调整。用Matlab7.1进行仿真，其结果表明：该控制算法对系统具有良好的控制效果，性能较常规PID得到较大改善。 最后，根据FPGA在伺服系统主要任务，用VHDL语言和原理图在FPGA芯片中分别编制实现DAC0832接口控制功能、光电编码器与脉冲发生电路的程序代码；并在Quartus II6.0环境下通过仿真，且得到仿真的波形符合系统功能要求。采用C语言编写在ARM中实现模糊神经网络PID控制算法的代码，通过CodeWarrior for ARM的编译无误后，生成可执行文件.axf,，调用AXD进行在线仿真调试。仿真结果表明：模糊神经网络PID算法对伺服系统能够进行有效控制。 结果表明：ARM作为伺服控制器的内核，其性价比与集成度高：用FPGA芯片实现接口电路使伺服控制器的可靠性高、速度快、可配置及连接方式灵活。因此采用基于ARM+FPGA的雷达伺服控制器，提高了系统的开放性、实时性、可靠性，降低了系统功耗，具有重要的应用价值。
上传时间： 2013-06-30
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阐述了一种基于反射式光电传感器的直流电机测速及控制系统K该系统可适用于无法采用旋转编码器和测速电机进行直流电机测速与控制的场合L 文中采用斯密特触发器、异或门、D 触发器以及可逆计数器设计了可用于脉冲
上传时间： 2013-05-17
上传用户：busterman
现代喷气织机以其高速、高性能等优势，占据了无梭织机的大部分市场，并成为最有发展前景的一种织机。送经、卷取机构是织机控制系统的重要组成部分，其对经纱张力的控制精度已成为评定织机质量的重要技术指标。因此，提高和改善喷气织机的电子送经和卷取控制系统的性能非常必要，而且，开发具有高速、高精度的独立电子送经和卷取控制模块具有广阔的应用前景。 本课题研究开发了一款独立的电子送经和卷取控制模块，通过人机界面或CAN通讯对该控制系统所需参数进行设置，使其可以根据参数设置应用于不同型号的喷气织机。通过对系统的控制分析，本课题主要从硬件电路设计、软件控制及张力控制算法三个方面进行研究。 首先，通过对喷气织机的性能要求及控制器结构与性能的综合考虑，系统采用以高速ARM7TDMI为内核的低功耗微处理器LPC2294作为系统控制器，该控制器不仅速度快、性能稳定，而且其丰富的外围模块大大简化了硬件电路的设计。硬件电路设计采用模块化设计方法，主要功能模块包括嵌入式最小系统模块、主轴编码器采集模块、张力采集模块、电机控制模块、通讯模块、人机界面模块、输入输出信号模块等。根据系统需要，对各个模块的控制器件进行选取，并设计出各个模块的接口电路。最后，为了提高系统的稳定性和可靠性，在硬件电路设计中采取了隔离、去耦等硬件抗干扰措施。 在软件设计方面，系统采用嵌入式实时操作系统μC/OS-II，便于系统升级和维护。在系统硬件平台的基础上，根据设计要求对操作系统内核进行剪裁和移植，并对系统时钟节拍进行修改。结合硬件电路及系统控制要求，对系统启动代码进行修改；并根据系统对各个功能模块控制的时效性要求，对系统任务进行合理规划。为了说明系统采用该RTOS的可行性，对实时性要求最高的张力采集任务进行了实时性分析。对CAN通讯协议进行制定和编程实现，并对I2C、CAN和LCD驱动程序进行开发，另外，对每个任务的功能及控制流程和任务间及任务与中断间的信息通讯进行了说明。系统在软件方面也采用了一定的抗干扰技术，对硬件抗干扰进行补充。 最后，针对经纱张力的非线性和滞后性等复杂特性，对张力调节采用模糊参数自整定PID控制算法，设计出张力模糊参数自整定PID控制器。并在Matlab及Simulink工具下，对PID控制器下的张力算法及模糊参数自整定PID控制器下的张力算法进行仿真研究。而且对张力模糊PID控制算法在LPC2294中的实现进行了说明。关键词：ARM； μC/OS-II；喷气织机；送经卷取；模糊PID
上传时间： 2013-06-11
上传用户：ivan-mtk
目前，织机向着高速化、智能化方向发展，无梭织机也越来越占主导地位，开发中高档织机控制系统是当前纺织机械领域的重要课题。织机的电子送经和卷取控制系统是中高档织机控制的关键技术之一，同时它也是无梭织机优越于有梭织机的重要特征之一，因此研究送经和卷取控制系统具有重要意义。 本文研究的内容是织机的送经和卷取控制系统，主要目的是保证织机在织造过程中纱线张力的动态稳定。主要工作如下： （1）在分析送经卷取系统原理和功能的基础上，提出了一种用较低成本完成所需控制功能的解决方案——以ARM嵌入式处理器S3C44B0为中心构建硬件平台，以嵌入式操作系统uClinux为基础构建软件平台。 （2）利用嵌入式处理器S3C44B0丰富的硬件资源，对电子送经卷取控制系统进行硬件设计：包括以S3C44B0为核心的最小系统电路的设计、与上位机通讯接口电路的设计、经纱张力检测与采样电路的设计、伺服电机驱动接口电路的设计和编码器接口电路的设计等． （3）利用嵌入式操作系统uClinux高实时、多任务等优点，对电子送经卷取控制系统进行软件设计： ●在分析uClinux系统的特点和功能的基础上，完成了在硬件电路板上的移植； ●在分析系统引导程序功能的基础上，完成了Boot Loader的设计； ●完成了系统设备驱动程序的设计：包括串口驱动程序设计、A/D驱动程序的设计和IIC驱动程序的设计等； ●在对织机工艺了解的基础上，以模块化的思想完成了系统应用程序的设计：包括张力传感器数据采集模块、控制算法模块和通讯模块等； （4）详细介绍了整个控制系统的调试过程。 本文设计的系统能使控制的经纱张力恒定，反应快速，控制精度高，很好地解决了开车痕等问题，能满足中高档织机的要求，具有实际应用价值。
上传时间： 2013-04-24
上传用户：athjac
遥感图像是深空探测和近地观测所得数据的重要载体，在军事和社会经济生活领域发挥着重要作用。由于遥感图像数据量巨大，它的存储和传输已成为遥感信息应用中的关键问题。图像压缩编码技术能降低图像冗余度，从而减小图像的存储容量和传输带宽，它的研究对于遥感图像应用具有重要的现实意义。CCSDS图像压缩算法是空间数据系统咨询委员会(CCSDS)提出的图像数据压缩算法。该算法复杂度较低，并行性好，适合于硬件实现，能实现对空间数据的实时处理，从而广泛应用于深空探测和近地观测。对于直接关系到军事战略、经济建设等方面的遥感图像的传输，必须对它进行加密处理。AES加密算法是由美国国家标准和技术研究所(NIST)于2000年发布的数据加密标准，它不但能抵抗各种攻击，保证加密数据的安全性，而且易于软件和硬件实现。本论文对CCSDS图像压缩算法和AES加密算法进行了研究，完成的主要工作包括： (1)研究了CCSDS图像压缩算法的原理和结构，用C语言实现了算法的编解码器，并与SPIHT算法和JPEG2000算法的性能进行了比较。 (2)研究了AES加密算法的原理和结构，用C语言实现了算法的加解密器。 (3)介绍了实现CCSDS图像压缩算法和AES加密算法的FPGA设计所选择的软件开发工具、开发语言和硬件开发平台。 (4)给出了CCSDS编码器的FPGA实现方法和实现性能。 (5)给出了AES加密器的FPGA实现方法和实现性能。 本文设计的CCSDS图像压缩和AES加密FPGA系统运用了流水线设计、高速内存设计、模块并行化设计和模块串行化设计等技术，在系统速度和资源面积上取得了较好的平衡，达到了预期的设计目的。
上传时间： 2013-07-15
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本文以星载图像数据的压缩与加密为背景，对CCSDS图像压缩算法和AES数据加密算法做了深入研究。文章的主要工作包括： (1)实现了CCSDS图像压缩算法的C程序，并且与SPIHT算法和JPEG2000算法在星载图像压缩领域做了简单的对比； (2)对原始CCSDS图像压缩算法进行了改进。实验结果表明，改进后的算法在提升算法性能的同时，降低了算法的复杂度； (3)研究了AES数据加密标准，并实现了该算法的C程序； (4)用VerilogHDL语言实现了CCSDS图像压缩算法和AES数据加密算法的编码器； (5)在FPGA硬件平台上，验证了这两种算法编码器的正确性和有效性。
上传时间： 2013-04-24
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