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故障排除

故障排除(faultclearance)是1998年公布的电气工程名词。
  • 基于FPGA的视频图像检测技术

    在图像处理及检测系统中,实时性要求往往影响着系统处理速度的性能。本文在分析研究视频检测技术及方法的基础上,应用嵌入式系统设计和图像处理技术,以交通信息视频检测系统为研究背景,展开了基于FPGA视频图像检测技术的研究与应用,通过系统仿真验证了基于FPGA架构的图像并行处理和检测系统具有较高的实时处理能力,能够准确并稳定地检测出运动目标的信息。可见FPGA对提高视频检测及处理的实时性是一个较好的选择。 本文主要研究的内容有: 1.分析研究了视频图像检测技术,针对传统基于PC构架和DSP处理器的视频检测系统的弊端,并从可靠性、稳定性、实时性和开发成本等因素考虑,提出了以FPGA芯片作为中央处理器的嵌入式并行数据处理系统的设计方案。 2.应用模块化的硬件设计方法,构建了新一代嵌入式视频检测系统的硬件平台。该系统由异步FIFO模块、图像空间转换模块、SRAM帧存控制模块、图像预处理模块和图像检测模块等组成,较好地解决了图像采样存储、处理和传输的问题,并为以后系统功能的扩展奠定了良好的基础。 3.在深入研究了线性与非线性滤波几种图像处理算法,分析比较了各自的优缺点的基础上,本文提出一种适合于FPGA的快速图像中值滤波算法,并给出该算法的硬件实现结构图,应用VHDL硬件描述语言编程、实现,仿真结果表明,快速中值滤波算法的处理速度较传统算法提高了50%,更有效地降低了系统资源占用率和提高了系统运算速度,增强了检测系统的实时性能。 4.研究了基于视频的交通车流量检测算法,重点讨论背景差分法,图像二值化以及利用直方图分析方法确定二值化的阈值,并对图像进行了直方图均衡处理,提高图像检测精度。并结合嵌入式系统处理技术,在FPGA系统上研究设计了这些算法的硬件实现结构,用VHDL语言实现,并对各个模块及相应算法做出了功能仿真和性能分析。 5.系统仿真与验证是整个FPGA设计流程中最重要的步骤,针对现有仿真工具用手动设置输入波形工作量大等弊病,本文提出了一种VHDL测试基准(TestBench)方法解决系统输入源仿真问题,用TEXTIO程序包设计了MATLAB与FPGA仿真软件的接口,很好地解决了仿真测试中因测试向量庞大而难以手动输入的问题。并将系统的仿真结果数据在MATLAB上还原为图像,方便了系统测试结果的分析与调试。系统测试的结果表明,运动目标的检测基本符合要求,可以排除行走路人等移动物体(除车辆外)的噪声干扰,有效地检测出正确的目标。 本文主要研究了基于FPGA片上系统的图像处理及检测技术,针对FPGA技术的特点对某些算法提出了改进,并在MATLAB、QuartusⅡ和ModelSim软件开发平台上仿真实现,仿真结果达到预期目标。本文的研究对智能化交通监控系统的车流量检测做了有益探索,对其他场合的图像高速处理及检测也具有一定的参考价值。

    标签: FPGA 视频图像 检测技术

    上传时间: 2013-07-13

    上传用户:woshiayin

  • 高压电器实用技术问答

    本书结合 目前高压电器的运行、操作、维护、检修中存在的问题, 系统地介 绍了电流互感器、电流互感器的故障诊断与处理, 电压互感器、电压互感器的故 障诊断与处理、互感器的检测与试验、现代互感器、少油断路器、真空断路器、真 空断路器的故障诊断与处理、真空断路器操作过电压、SF6 断路器、SF6 断路器的 故障诊断与处理、断路器操作机构等 内容, 以问答形式深入浅出地阐述了高压 电器运行、维护、检修中经常涉及的电工理论知识和实际操作技能。

    标签: 高压电器 实用技术 问答

    上传时间: 2013-05-28

    上传用户:RedLeaves1995

  • 基于FPGA的PID控制器研究与实现

    基于微处理器的数字PID控制器改变了传统模拟PID控制器参数整定不灵活的问题。但是常规微处理器容易在环境恶劣的情况下出现程序跑飞的问题,如果实现PID软算法的微处理器因为强干扰或其他原因而出现故障,会引起输出值的大幅度变化或停止响应。而FPGA的应用可以从本质上解决这个问题。因此,利用FPGA开发技术,实现智能控制器算法的芯片化,使之能够广泛的用于各种场合,具有很大的应用意义。 首先分析FPGA的内部结构特点,总结FPGA设计技术及开发流程,指出实现结构优化设计,降低设计难度,是扩展设计功能、提高芯片性能和产品性价比的关键。控制系统由四个模块组成,主要包括核心控制器模块、输入输出模块以及人机接口。其中控制器部分为系统的关键部件。在分析FPGA设计结构类型和特点的基础上,提出一种基于FPGA改进型并行结构的PID温度控制器设计方法。在PID算法与FPGA的运算器逻辑映像过程中,采用将补码的加法器代替减法器设计,增加整数运算结果的位扩展处理,进行不同数据类型的整数归一化等不同角度的处理方法融合为一体,可以有效地减少逻辑运算部件。应用Ouartus Ⅱ图形输入与Verilog HDL语言相结合设计实现了PID控制器,用Modelsim仿真验证了设计结果的正确性,用Synplify Pro进行电路综合,在Quaitus Ⅱ软件中实现布局布线,最后生成FPGA的编程文件。根据控制系统的要求,论文设计完成了12位模数AD转换器、数据显示器、按键等相关外围接口电路。 将一阶、纯滞后、大惯性电阻炉温作为控制对象,以EP1C3T144 FPGA为核心,构建PID控制系统。在采用Pt100温度传感器、分辨率为2℃、最大温度控制范围0~400℃的条件下,实验结果表明,达到无超调的稳定控制要求,为降低FPGA实现PID控制器的设计难度提供了有效的方法。

    标签: FPGA PID 控制器

    上传时间: 2013-05-24

    上传用户:gyq

  • 基于FPGA的便携式振动频谱分析仪

    该论文基于NIOS Ⅱ软核处理器和Altera的FPGA技术,设计了一种便携式的振动频谱分析仪,用于旋转机械的故障监测和诊断。以SOPC技术为手段,将信号采集和信号处理电路通过可编程片上系统来实现,其特点是将对ADC的控制、数字信号的滤波、快速傅立叶变换的设计,通过FPGA芯片集成在一起,以NIOS Ⅱ来完成32位CPU的状态控制功能。工程机械、汽车车辆中都存在诸如发动机类的旋转机械,这类设备的异常振动往往会影响正常工作,严重时还会出现各种重大事故,该分析仪可以实时地或定期地对发动机、齿轮箱等旋转机械进行振动频谱分析和监测,运用于民用机械能产生非常好的经济效益。 该论文从四个方面进行了研究工作。其一,利用FPGA对ADC芯片的工作进行控制,使其在规定的时间内与DSP模块进行数据交换,并对ADC各引脚时序进行控制,使两者协调同步工作,编制了相应的VHDL语言程序。其二,采用SOPC Builder设计开发,实现了基于NIOS Ⅱ的32位CPU软核,创建了相应的C/C++和汇编的宏代码,使得软件可以访问用户自定义逻辑。对顶层设计产生的VHDL的RTL代码和仿真文件进行了综合、编译适配以及仿真。其三,配合Matlab和DSP Builder的强大功能进行DSP模块设计,开发出了FIR和FFT等功能模块,并且添加到SOPC系统中,使其可以由NIOS Ⅱ很容易的调用。其四,在NIOS Ⅱ系统中添加了uC/OS Ⅱ操作系统,提高了整个系统的稳定性,并且降低了开发难度,提高了系统升级的能力。由于整个设计是基于FPGA开发的,所以该系统包括了所有FPGA系统的特点,包括并行的DSP处理、在系统可编程、升级简单等特点,极易使设计产品化。

    标签: FPGA 便携式 振动频谱 分析仪

    上传时间: 2013-04-24

    上传用户:amandacool

  • chipscop7.1i.rar

    ChipScope Pro具有传统逻辑分析仪的功能,是针对Xilinx Virtex Pro等系列FPGA的在线片内信号分析工具,主要功能是通过JTAG口,实时、在线、方便地观察到FPGA内部的信号,给调试、故障定位提供极大的方便。ChipScope Pro的基本原理是利用FPGA中未使用的BlockRam,根据用户设定的触发条件将信号实时的保存到这些BlockRam中,然后通过JTAG口传送到计算机,最后在计算机屏幕上显示出时序波形。

    标签: chipscop 7.1

    上传时间: 2013-05-22

    上传用户:wangrijun

  • 485通讯例程

    笔者在火灾自动报警系统的联网设计中,经大量试验,发现在使用RS-485总线时,如果简单地按常规方式设计电路,那么在实际工程中可能存在以下两个问题:一是通信数据收发不可靠;二是在多机通信方式下,一个节点的故障(如死机)往往会使得整个系统的通信框架崩溃,而且给故障的排查带来困难。针对上述问题,对485总线接口的软硬件设计采取了有效的改进措施,大大提高了联网系统的可靠性和稳定性。

    标签: 485 通讯

    上传时间: 2013-05-28

    上传用户:pioneer_lvbo

  • 高精度智能测时仪的设计

    区截装置测速法是现代靶场中弹丸测速的普遍方法,测时仪作为区截装置测速系统的主要组成部分,其性能直接影响弹丸测速的可靠性和精度。本文根据测时仪的发展现状,按照设计要求,设计了一种基于单片机和FPGA的高精度智能测时仪,系统工作稳定、操作方便、测时精度可达25ns。 本文详细给出了系统的设计方案。该方案提出了一种在后端用单片机处理干扰信号的新方法,简化了系统硬件电路的设计,提高了测时精度;提出了一种基于系统基准时间的测时方案,相对于传统的测时方法,该方案为分析试验过程提供了有效数据,进一步提高了系统工作的可靠性;给出了一种输入信息处理的有效方法,保证了系统工作的稳定性。 本文设计了系统FPGA逻辑电路,包括输入信号的整形滤波、输入信号的捕捉、时基模块、异步时钟域间数据传递、与单片机通信、单片机I/O总线扩展等;实现了系统单片机程序,包括单片机和。FPGA的数据交换、干扰信号排除和弹丸测速测频算法的实现、LCD液晶菜单的设计和打印机的控制、FLASH的读写、上电后对FPGA的配置、与上位机的通信等;分析了系统的误差因素,给出了系统的误差和相对误差的计算公式;通过实验室模拟测试以及靶场现场测试,结果表明系统工作可靠、精度满足设计要求、人机界面友好。

    标签: 高精度 仪的设计

    上传时间: 2013-07-25

    上传用户:pwcsoft

  • FPGA测试方法研究

    FPGA(Field Programmable Gate Arrays)是目前广泛使用的一种可编程器件,FPGA的出现使得ASIC(Application Specific Integrated Circuits)产品的上市周期大大缩短,并且节省了大量的开发成本。目前FPGA的功能越来越强大,满足了目前集成电路发展的新需求,但是其结构同益复杂,规模也越来越大,内部资源的种类也R益丰富,但同时也给测试带来了困难,FPGA的发展对测试的要求越来越高,对FPGA测试的研究也就显得异常重要。 本文的主要工作是提出一种开关盒布线资源的可测性设计,通过在FPGA内部加入一条移位寄存器链对开关盒进行配置编程,使得开关盒布线资源测试时间和测试成本减少了99%以上,而且所增加的芯片面积仅仅在5%左右,增加的逻辑资源对FPGA芯片的使用不会造成任何影响,这种方案采用了小规模电路进行了验证,取得了很好的结果,是一种可行的测试方案。 本文的另一工作是采用一种FPGA逻辑资源的测试算法对自主研发的FPGA芯片FDP250K的逻辑资源进行了严格、充分的测试,从FPGA最小的逻辑单元LC开始,首先得到一个LC的测试配置,再结合SLICE内部两个LC的连接关系得到一个SLICE逻辑单元的4种测试配置,并且采用阵列化的测试方案,同时测试芯片内部所有的逻辑单元,使得FPGA内部的逻辑资源得完全充分的测试,测试的故障覆盖率可达100%,测试配置由配套编程工具产生,测试取得了完满的结果。

    标签: FPGA 测试 方法研究

    上传时间: 2013-06-29

    上传用户:Thuan

  • 基于FPGA的虚拟逻辑分析仪

    随着数字技术、大规模集成电路及计算机的大量普及和快速发展,逻辑分析仪(Logic Analyzer,简称LA)作为数字系统的数据域测试仪器中应用最为广泛、最有代表性的一种通用测试仪器,为解决越来越复杂的数字系统的检测和故障诊...

    标签: FPGA 虚拟逻辑 分析仪

    上传时间: 2013-05-17

    上传用户:鱼鱼鱼yu

  • 电视技术习题集(问答题)

    电视技术习题集(问答题)一、 单项选择题  1.彩色电视机出现无光栅、无图像、无伴音故障现象的可能部位是(     )。

    标签: 电视技术 问答

    上传时间: 2013-07-29

    上传用户:pwcsoft