Verilog实现的DDS正弦信号发生器和测频测相模块
Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，...
插卡模块技术资料
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DSP和FPGA的高精度数据采集卡设计
数据采集 基于DSP和FPGA的高精度数据采集卡设计...
关于对数据采集卡的基于PC104总线的读写程序
是关于对数据采集卡的基于PC104总线的读写程序，开发环境Quarters , 用VHDL语言编写。...
fpga cpld 常见模块设计
fpga cpld 常见模块设计，包括基于fpga 的全数字锁向环，基于fpga cpld 的半整数分频器的设计等，很有用...
一个好程序关于CPLD的直线插补在数字积分中的应用
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CPLD、FPGA在EL显示模块及接口电路中的应用
CPLD、FPGA在EL显示模块及接口电路中的应用,cpld实现数字电路取代，fpga取代液晶显示专用控制芯片。...
关于用CPLD和FPGA做插补算法的内容,对于想用FPGA做控制的朋友是个好的借鉴!
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一个很好的VHDL实现的功能模块程序
一个很好的VHDL实现的功能模块程序,希望你可以用的上!...
FPGA光电编码器输入模块
本人编写的FPGA光电编码器输入模块,没有实验,但仿真基本实现,希望有参考价值....
利用VHDL语言编写的一个crc功能模块
利用VHDL语言编写的一个crc功能模块，可下载到FPGA实现功能...