本文探讨的重点是PCB设计人员利用IP，并进一步采用拓扑规划和布线工具来支持IP，快速完成整个PCB设计。从图1可以看出，设计工程师的职责是通过布局少量必要元件、并在这些元件之间规划关键互连路径来获取IP。一旦获取到了IP，就可将这些IP信息提供给PCB设计人员，由他们完成剩余的设计。 图1：设计工程师获取IP，PCB设计人员进一步采用拓扑规划和布线工具支持IP，快速完成整个PCB设计。现在无需再通过设计工程师和PCB设计人员之间的交互和反复过程来获取正确的设计意图，设计工程师已经获取这些信息，并且结果相当精确，这对PCB设计人员来说帮助很大。在很多设计中，设计工程师和PCB设计人员要进行交互式布局和布线，这会消耗双方许多宝贵的时间。从以往的经历来看交互操作是必要的，但很耗时间，且效率低下。设计工程师提供的最初规划可能只是一个手工绘图，没有适当比例的元件、总线宽度或引脚输出提示。随着PCB设计人员参与到设计中来，虽然采用拓扑规划技术的工程师可以获取某些元件的布局和互连，不过，这个设计可能还需要布局其它元件、获取其它IO及总线结构和所有互连才能完成。PCB设计人员需要采用拓扑规划，并与经过布局的和尚未布局的元件进行交互，这样做可以形成最佳的布局和交互规划，从而提高PCB设计效率。随着关键区域和高密区域布局完成及拓扑规划被获取，布局可能先于最终拓扑规划完成。因此，一些拓扑路径可能必须与现有布局一起工作。虽然它们的优先级较低，但仍需要进行连接。因而一部分规划围绕布局后的元件产生了。此外，这一级规划可能需要更多细节来为其它信号提供必要的优先级。
上传时间： 2014-01-14
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教学提示：前章介绍的基本逻辑指令和梯形图主要用于设计满足一般控制要求的PLC程序。对于复杂控制系统来说，系统输入输出点数较多，工艺复杂，每一工序的自锁要求及工序与工序间的相互连锁关系也复杂，直接采用逻辑指令和梯形图进行设计较为困难。在实际控制系统中，可将生产过程的控制要求以工序划分成若干段，每一个工序完成一定的功能，在满足转移条件后，从当前工序转移到下道工序，这种控制通常称为顺序控制。为了方便地进行顺序控制设计，许多可编程控制器设置有专门用于顺序控制或称为步进控制的指令，FX2N PLC在基本逻辑指令之外增加了两条步进指令，同时辅之以大量的状态器S，结合状态转移图就很容易编出复杂的顺序控制程序 教学要求：本章要求学生熟练掌握FX2N的步进指令和状态转移图的功能、应用范围和使用方法。重点让学生掌握步进指令和状态转移图编程的规则、步骤与编程方法，并能编写一些工程控制程序 第四章 状态转移图及步进指令 5.1 状态转移图5.2 步进梯形图及步进指令5.2.1 步进梯形图5.2.2 步进指令5.3 步进梯形图指令编程基本方法5.4 状态转移图常见流程状态得编程5.4.1 单流程状态编程5.4.2 跳转与重复状态编程5.4.3 选择分支与汇合状态编程5.4.4 并行分支与汇合状态5.4.5 分支与汇合得组合5.5 状态转移图及步进指令的应用实例
上传时间： 2013-11-05
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通用阵列逻辑GAL实现基本门电路的设计 一、实验目的 1.了解GAL22V10的结构及其应用； 2.掌握GAL器件的设计原则和一般格式； 3.学会使用VHDL语言进行可编程逻辑器件的逻辑设计； 4.掌握通用阵列逻辑GAL的编程、下载、验证功能的全部过程。 二、实验原理 1. 通用阵列逻辑GAL22V10 通用阵列逻辑GAL是由可编程的与阵列、固定（不可编程）的或阵列和输出逻辑宏单元（OLMC）三部分构成。GAL芯片必须借助GAL的开发软件和硬件，对其编程写入后，才能使GAL芯片具有预期的逻辑功能。GAL22V10有10个I/O口、12个输入口、10个寄存器单元，最高频率为超过100MHz。 ispGAL22V10器件就是把流行的GAL22V10与ISP技术结合起来，在功能和结构上与GAL22V10完全相同，并沿用了GAL22V10器件的标准28脚PLCC封装。ispGAl22V10的传输时延低于7.5ns，系统速度高达100MHz以上，因而非常适用于高速图形处理和高速总线管理。由于它每个输出单元平均能够容纳12个乘积项，最多的单元可达16个乘积项，因而更为适用大型状态机、状态控制及数据处理、通讯工程、测量仪器等领域。ispGAL22V10的功能框图及引脚图分别见图1-1和1-2所示。 另外，采用ispGAL22V10来实现诸如地址译码器之类的基本逻辑功能是非常容易的。为实现在系统编程，每片ispGAL22V10需要有四个在系统编程引脚，它们是串行数据输入(SDI)，方式选择(MODE)、串行输出(SDO)和串行时钟(SCLK)。这四个ISP控制信号巧妙地利用28脚PLCC封装GAL22V10的四个空脚，从而使得两种器件的引脚相互兼容。在系统编程电源为+5V，无需外接编程高压。每片ispGAL22V10可以保证一万次在系统编程。 ispGAL22V10的内部结构图如图1-3所示。 2.编译、下载源文件 用VHDL语言编写的源程序，是不能直接对芯片编程下载的，必须经过计算机软件对其进行编译，综合等最终形成PLD器件的熔断丝文件(通常叫做JEDEC文件，简称为JED文件)。通过相应的软件及编程电缆再将JED数据文件写入到GAL芯片，这样GAL芯片就具有用户所需要的逻辑功能。 3.工具软件ispLEVER简介 ispLEVER 是Lattice 公司新推出的一套EDA软件。设计输入可采用原理图、硬件描述语言、混合输入三种方式。能对所设计的数字电子系统进行功能仿真和时序仿真。编译器是此软件的核心，能进行逻辑优化，将逻辑映射到器件中去，自动完成布局与布线并生成编程所需要的熔丝图文件。软件中的Constraints Editor工具允许经由一个图形用户接口选择I/O设置和引脚分配。软件包含Synolicity公司的“Synplify”综合工具和Lattice的ispVM器件编程工具，ispLEVER软件提供给开发者一个简单而有力的工具。
上传时间： 2013-11-17
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磁芯电感器的谐波失真分析 摘 要：简述了改进铁氧体软磁材料比损耗系数和磁滞常数ηB，从而降低总谐波失真THD的历史过程，分析了诸多因数对谐波测量的影响，提出了磁心性能的调控方向。 关键词：比损耗系数， 磁滞常数ηB ，直流偏置特性DC-Bias，总谐波失真THD Analysis on THD of the fer rite co res u se d i n i nductancShi Yan Nanjing Finemag Technology Co. Ltd., Nanjing 210033 Abstract: Histrory of decreasing THD by improving the ratio loss coefficient and hysteresis constant of soft magnetic ferrite is briefly narrated. The effect of many factors which affect the harmonic wave testing is analysed. The way of improving the performance of ferrite cores is put forward. Key words: ratio loss coefficient，hysteresis constant，DC-Bias，THD 近年来，变压器生产厂家和软磁铁氧体生产厂家，在电感器和变压器产品的总谐波失真指标控制上，进行了深入的探讨和广泛的合作，逐步弄清了一些似是而非的问题。从工艺技术上采取了不少有效措施，促进了质量问题的迅速解决。本文将就此热门话题作一些粗浅探讨。 一、 历史回顾 总谐波失真（Total harmonic distortion） ，简称THD，并不是什么新的概念，早在几十年前的载波通信技术中就已有严格要求<1>。1978年邮电部公布的标准YD/Z17－78“载波用铁氧体罐形磁心”中，规定了高μQ材料制作的无中心柱配对罐形磁心详细的测试电路和方法。如图一电路所示，利用LC组成的150KHz低通滤波器在高电平输入的情况下测量磁心产生的非线性失真。这种相对比较的实用方法，专用于无中心柱配对罐形磁心的谐波衰耗测试。 这种磁心主要用于载波电报、电话设备的遥测振荡器和线路放大器系统，其非线性失真有很严格的要求。 图中 ZD —— QF867 型阻容式载频振荡器，输出阻抗 150Ω， Ld47 —— 47KHz 低通滤波器，阻抗 150Ω，阻带衰耗大于61dB， Lg88 ——并联高低通滤波器，阻抗 150Ω，三次谐波衰耗大于61dB Ld88 ——并联高低通滤波器，阻抗 150Ω，三次谐波衰耗大于61dB FD —— 30～50KHz 放大器， 阻抗 150Ω， 增益不小于 43 dB，三次谐波衰耗b3(0)≥91 dB, DP —— Qp373 选频电平表，输入高阻抗， L ——被测无心罐形磁心及线圈， C ——聚苯乙烯薄膜电容器CMO-100V-707APF±0.5%,二只。 测量时，所配用线圈应用丝包铜电磁线SQJ9×0.12(JB661-75)在直径为16.1mm的线架上绕制 120 匝， （线架为一格） ， 其空心电感值为 318μH（误差1％） 被测磁心配对安装好后，先调节振荡器频率为 36.6～40KHz， 使输出电平值为+17.4 dB， 即选频表在 22′端子测得的主波电平 （P2）为+17.4 dB，然后在33′端子处测得输出的三次谐波电平（P3）， 则三次谐波衰耗值为：b3(+2)= P2+S+ P3 式中：S 为放大器增益dB 从以往的资料引证， 就可以发现谐波失真的测量是一项很精细的工作，其中测量系统的高、低通滤波器，信号源和放大器本身的三次谐波衰耗控制很严，阻抗必须匹配，薄膜电容器的非线性也有相应要求。滤波器的电感全由不带任何磁介质的大空心线圈绕成，以保证本身的“洁净” ，不至于造成对磁心分选的误判。 为了满足多路通信整机的小型化和稳定性要求， 必须生产低损耗高稳定磁心。上世纪 70 年代初，1409 所和四机部、邮电部各厂，从工艺上改变了推板空气窑烧结，出窑后经真空罐冷却的落后方式，改用真空炉，并控制烧结、冷却气氛。技术上采用共沉淀法攻关试制出了μQ乘积 60 万和 100 万的低损耗高稳定材料，在此基础上，还实现了高μ7000～10000材料的突破，从而大大缩短了与国外企业的技术差异。当时正处于通信技术由FDM（频率划分调制）向PCM（脉冲编码调制） 转换时期， 日本人明石雅夫发表了μQ乘积125 万为 0.8×10 ，100KHz）的超优铁氧体材料<3>，其磁滞系数降为优铁
上传时间： 2013-12-15
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这个软件需要你的本机操作的。其他机器是算不出来的！ 就是说 一台电脑只有一个注册码对应！ 这里有个办法： MULTISIM2001安装方法： 一：运行SETUP.EXE安装。在安装时，要重新启动计算机一次。 二：启动后在“开始>程序”中找到STARTUP项，运行后，继续进行安装，安装过程中，第一次要求输入“CODE"码时， 输入“PP-0411-48015-7464-32084"输入后，会提示"VALID SERIAL NUMBER FOR MULTISIM 2001 POWER-PRO." 按确定，又会出现一个“feature code”框，输入“FC-6424-04180-0044-13881”后， 在弹出的对话框中选择“取消”，一路确定即可完成安装。 三：1.运行VERILOG目录内的SETUP安装 2.运行FPGA目录内的SETUP安装 3.将CRACK目录内的LICMGR.DLL拷贝到WINDOWS系统的SYSTEM 目录内 4.并将VERILOG安装目录内的同名文件删除 5.将SILOS.LIC文件拷到VERILOG安装目录内覆盖原文件，并作如下编辑： 6.将“COMPUTER_NAME”替换为你的机器名 7.将“D:\MULTISIM\VERILOG\PATH_TO_SIMUCAD.EXE”替换为你的 实际安装路径。如此你便可以使用VERILOG了。 四：安装之后，运行MULTISIM2001,会要求输入“RELEASE CODE",不用着急， 记下“SERIAL NUMBER"和“SIGNATURE NUMBER", 使用CRACK目录内的注册器“MULTISIM KEYGEN.EXE" 将刚才记下的两个号码分别填入后， 即可得到"RELEASE CODE", 以后就可以正常使用了。 五：接下来运行 database update目录中的几个文件， 进行数据库合并即可。祝你成功！！ 六：启动MULTISIM2001时候的注册码 1： PP-0411-48015-7464-32084 2： 37506-86380 3:的三个空格 1975 2711 4842 里面包含了：Multisim2001汉化破解版、Multisim.V10.0.1.汉化破解版图解 解压密码：www.pp51.com
上传时间： 2013-11-16
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为了对航空发动机装配过程进行有效地监控与控制，提高产品的装配质量与效率，降低出错率，本文提出了一种装配过程控制的管理平台，建立了装配技术状态的数据模型， 实现对整个装配数据的管理与跟踪，采用三维装配工艺可视化提高了装配的理解性，并对物料的流转状态进行控制，从而对整个航空发动机装配过程进行有效的控制。
上传时间： 2013-11-19
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将支持向量机应用到典型的时变、非线性工业过程—— 连续搅拌反应釜的辨识中, 并与BP 神经网络建模相比较, 仿真结果表明了支持向量机的有效性与优越性. 支持向量机以其出色的学习能力为工业过程的辨识提出了一种新的途径.
上传时间： 2013-10-17
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基于探索 RLC二阶电路仿真实验技术的目的，采用Multisim仿真软件对RLC二阶电路暂态过程进行了仿真实验测试，给出了电路在过阻尼、临界阻尼、欠阻尼等情况下零输入响应及零状态响应的Multisim仿真方案，并介绍了不同工作条件下仿真时Multisim中信号源的选取及设置条件。结论是仿真实验可直观形象地描述RLC二阶电路的工作过程，将电路的硬件实验方式向多元化方式转移，利于培养知识综合、知识应用、知识迁移的能力，使电路分析更加灵活和直观。
上传时间： 2013-11-20
上传用户：谁偷了我的麦兜
CDMA技术是当前无线电通信，尤其是移动通信的主要技术，不论是在中国已经建立的IS-95规范的中国联通CDMA网、各大移动通信运营商正准备实验及建立第三代(3G)系统还是大设备研发商已经在开发的三代以后(也称为4G)更宽带宽的移动通信系统，CDMA都是主要的选择。CDMA概念可以简单地解释为基于扩频通信的调制和多址接入方案。其反向链路有接入信道和反向业务信道组成。接入信道用于短信令消息交换、能提供呼叫来源、寻呼响应、指令和注册。 本设计选取CDMA通信系统中的接入信道部分进行仿真与分析。首先，通过学习相应的理论知识，熟悉接入信道实现的过程，对每一步的原理有了较深的理解，同时，也对MATALB软件进行熟悉和了解，对MATLAB软件中的SIMULINK部分及其内部的CDMA模块用法和参数设置进行熟悉，然后运用MATLAB软件对接入信道部分进行设计，并逐步地对各个模块进行分析、仿真与验证。目的是通过毕业设计工作熟悉现代无线通信系统的基本构成与基本工作原理，重点掌握卷积编码、块交织和码扩展等相关编码技术，并能将这些技术应用实际系统设计，提高自己对CDMA通信系统知识的认识。 关键字：CRC;卷积编码;块重复;交织;长码;沃尔什;PN序列
上传时间： 2013-11-02
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DEll016是一种可支持ARINCA-29总线协议的串行接收、发送器件。介绍了一种基于DEll016的ARINCA29通信接口的设计方法，设计了一种基于DSP处理器的429总线转换接口电路，并给出了DEll016的数据收发过程；软件方面采用嵌入式实时操作系统DSP／BIOS为平台．重点介绍了软件驱动程序的编写。关键词：DSP／BIOS；ARINC429总线；DEll016 航空电子综合系统是将航空电子设备通过总线综合成一个分布式通信系统，各个独立的分系统都是由计算机来完成数据的采集、计算、处理和通信的。数据总线被称为现代航空电子系统的“骨架”。ARlNc429是航空电子系统之间最常用的通信总线⋯之一。它符合航空电子设备数字数据传输标准。要在计算机上实现ARINC429总线数据的接收和发送，必须实现429总线与计算机总线之间的数据传输。本文提出了一种以DSP芯片TMS320F2812【2t51为控制核心，以嵌入式系统DsP／BIOS为平台的ARINC 429总线接口的设计方案。 ARINC429是一种广泛应用于民用和军用飞机的串行数据总线结构，是一种单向广播式数据总线，通讯介质采用的是双绞屏蔽线，通信采用双极性归零制的三态码调制方式，基本信息单元是由32位构成的一个数据字。数据传输采用广播传输原理，按开环进行传输，传输速率有两种：高速传输率为lOOkbps±1％，低速传输率为12～14．5kbps 4-l％。奇偶校验位作为每个数字的一部分进行传输，允许接收器完成简单的误差校验。该总线具有抗干扰能力强、连线简单、可靠性高、数据资源丰富、数据精度高等优点。绝大多数的现役民用飞机，如波音系列飞机、欧洲空中客车等机种，其航空电子设备系统间的信息交换采用的就是ARINCA29串行总线标准。
上传时间： 2013-11-17
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