快速傅立叶变换(FFT)技术是数字信号处理中的核心技术,它已广泛应用于数字信号处理的各个领域,长期以来一直是一个重要的研究课题。近年来,专用数字信号处理器以其优化的硬件结构和优良的性能价格比为FFT的实现提供了一种有效的途径,其中最具有代表性的是美国TI公司的TMS320系列DSP。 本文首先分析了常用FFT算法原理,并进行了算法的讨论和比较,然后详细论述了以浮点型DSP为核心的实现FFT算法的硬件平台的设计。平台的硬件电路主要包括数据采集部分、数据处理部分、数据存储部分和数据显示部分。其中采集部分采用12位高速的A/D转换芯片MAX197,数据处理部分采用32位浮点型DSP芯片-TMS320VC33,数据存储部分采用了大容量的FLASH芯片——K9F2808UOA,数据显示部分采用PHILIPS公司的高亮度、宽视角的TFT彩色液晶显示屏。 为了扩展系统的通信能力,通信接口我们选择CAN总线。软件部分选用了频率抽取基2FFT、分裂基FFT和实序列FFT算法,用C语言进行编程。最后部分是进行软硬件的联合调试,并在此基础上进行了FFT算法实现。 论文结尾以实际的实验曲线分析验证了算法的正确性,同时针对实验中产生的误差找出了原因,并提出了解决的方法。实验结果表明采用浮点DSP实现FFT算法方便且有较高的实时性,可以应用到电力系统谐波分析、振动测试及铁路检测等各个领域。
上传时间: 2013-04-24
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不间断电源(UPS)是一种能提供优质电源并保证电源供应连续的电力电子装置。它的应用范围广泛,在很多领域,UPS已经成了标准配置。采用数字信号处理器(DSP)实现UPS的数字化控制是当前许多UPS设计者关注的问题。DSP在UPS中的应用主要集中在两个方面:一是将各种先进的控制方法用于逆变实时数字控制;二是利用DSP实现更准确更迅速的锁相环控制。 本文分析了当前逆变控制的各种方案,针对逆变的扰动及谐波周期出现的特点,采用了重复控制来提高逆变输出的稳态特性。因为重复控制具有一个周期延迟控制的特点,本文也采用了PID控制来改善逆变控制的动态性能。本文分析了目前重复控制的常用方案,在建立UPS逆变滤波电路数学模型的基础上设计了新的重复控制和PID控制结合的方案。对重复控制与PID复合控制方案在MATLAB中作了仿真。仿真试验证明了控制方案的有效性。 在硬件方面,设计了在线式UPS系统中DSP的接口电路,其中包括DSP供电电路,蓄电池电压过低检测电路,市电及输出电压过零检测等电路。对DSP的资源进行了分配,充分利用了DSP的外设多和速度快的特点。 在软件方面,设计了各部分的程序,其中包括主程序,软件锁相及正弦参考信号生成程序,输出有效值控制程序以及各种相关的中断及保护程序。 本文结合实际,搭建了实验线路,给出了实验线路的原理及各部分的实验电路。该实验电路可对逆变控制过程和锁相环节进行控制实验。 本文将PID控制与重复控制相结合,对逆变器输出进行控制,验证了重复控制与PID复合控制的有效性。本文还对UPS的DSP数字化控制作了研究,这些都对UPS技术的进步有积极的作用。
上传时间: 2013-05-17
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上传时间: 2013-07-21
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本论文在详细研究MIL-STD-1553B数据总线协议以及参考国外芯片设计的基础上,结合目前新兴的EDA技术和大规模可编程技术,提出了一种全新的基于FPGA的1553B总线接口芯片的设计方法。 从专用芯片实现的具体功能出发,结合自顶向下的设计思想,给出了总线接口的总体设计方案,考虑到电路的具体实现对结构进行模块细化。在介绍模拟收发器模块的电路设计后,重点介绍了基于FPGA的BC、RT、MT三种类型终端设计,最终通过工作方式选择信号以及其他控制信号将此三种终端结合起来以达到通用接口的功能。同时给出其设计逻辑框图、算法流程图、引脚说明以及部分模块的仿真结果。为了资源的合理利用,对其中相当部分模块进行复用。在设计过程中采用自顶向下、码型转换中的全数字锁相环、通用异步收发器UART等关键技术。本设计使用VHDL描述,在此基础之上采用专门的综合软件对设计进行了综合优化,在FPGA芯片EP1K100上得以实现。通过验证证明该设计能够完成BC/RT/MT三种模式的工作,能处理多种消息格式的传输,并具有较强的检错能力。 最后设计了总线接口芯片测试系统,选择TMS320LF2407作为主处理器,测试主要包括主处理器的自发自收验证,加入RS232串口调试过程提高测试数据的直观性。验证的结果表明本文提出的设计方案是合理的。
上传时间: 2013-06-04
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常用模拟集成电路,主要介绍运放、乘法器、有源滤波器、开关电容滤波等。
上传时间: 2013-05-17
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本文主要研究采用以太网接口芯片RTL8019AS和TCP/IP协议实现嵌入式WEB服务器,此服务器可以使各种带串口的工控设备和数据采集设备很容易地连接到Internet,这样就能够利用Internet实现对各种嵌入式设备的低成本远程访问和资源共享。 本研究实现的嵌入式WEB服务器以STC89C51系列单片机为核心,用其串口作为与嵌入式设备的接口,用RTL8019AS芯片和RJ-45作为以太网接口,并通过软件实现RS-232与TCP/IP协议的转换,通过以太网实现嵌入式设备与远程计算机之间的双向数据通信,给出了硬件设计和软件实现方案。硬件主要研究微控制器和以太网控制芯片之间的接口设计和以太网控制芯片RTL8019AS的驱动。软件部分研究实现了TCP/IP的各层协议,包含了ARP、IP、ICMP、UDP、TCP、HTTP等,在实际中得以应用,如对于蓄电池电压的远程检测等。 研究结果表明,利用嵌入式WEB服务器将嵌入式设备连入Internet网络是切实可行的。经实验测试整个系统占用资源少,成本较低、移植性较好,能够完成常用的相关网络通讯功能,网络数据传输可靠性较好。
上传时间: 2013-04-24
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上传时间: 2013-05-21
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标签: 元件
上传时间: 2013-05-24
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高性能ADC产品的出现,给混合信号测试领域带来前所未有的挑战。并行ADC测试方案实现了多个ADC测试过程的并行化和实时化,减少了单个ADC的平均测试时间,从而降低ADC测试成本。 本文实现了基于FPGA的ADC并行测试方法。在阅读相关文献的基础上,总结了常用ADC参数测试方法和测试流程。使用FPGA实现时域参数评估算法和频域参数评估算法,并对2个ADC在不同样本数条件下进行并行测试。 通过在FPGA内部实现ADC测试时域算法和频域算法相结合的方法来搭建测试系统,完成音频编解码器WM8731L的控制模式接口、音频数据接口、ADC测试时域算法和频域算法的FPGA实现。整个测试系统使用Angilent 33220A任意信号发生器提供模拟激励信号,共用一个FPGA内部实现的采样时钟控制模块。并行测试系统将WM8731.L片内的两个独立ADC的串行输出数据分流成左右两通道,并对其进行串并转换。然后对左右两个通道分别配置一个FFT算法模块和时域算法模块,并行地实现了ADC参数的评估算法。 在样本数分别为128和4096的实验条件下,对WM8731L片内2个被测.ADC并行地进行参数评估,被测参数包括增益GAIN、偏移量OFFSET、信噪比SNR、信号与噪声谐波失真比SINAD、总谐波失真THD等5个常用参数。实验结果表明,通过在FPGA内配置2个独立的参数计算模块,可并行地实现对2个相同ADC的参数评估,减小单个ADC的平均测试时间。 FPGA片内实时评估算法的实现节省了测试样本传输至自动测试机PC端的时间。而且只需将HDL代码多次复制,就可实现多个被测ADC在同一时刻并行地被评估,配置灵活。基于FPGA的ADC并行测试方法易于实现,具有可行性,但由于噪声的影响,测试精度有待进一步提高。该方法可用于自动测试机的混合信号选项卡或测试子系统。 关键词:ADC测试;并行;参数评估;FPGA;FFT
上传时间: 2013-07-11
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随着电子技术的不断发展和进步,嵌入式系统也越来越广泛的渗入到人类生活的方方面面。我们生活中常用的手机、数码相机、掌上电脑、便携式扫描仪等等都应用到了嵌入式系统。 论文首先介绍了嵌入式系统,包括嵌入式系统的构成、特点、发展趋势以及FPGA在嵌入式中的应用等,指明嵌入式系统设计一般可分为硬件设计和软件设计两部分。 硬件设计部分,首先介绍了FPGA的相关知识,包括FPGA构成、特性、开发工具、开发流程等,并对论文中选用的Altera公司的CyclonⅡ器件做了详细的介绍。利用SOPC Builder、NiosⅡ等工具设计创建了NiosⅡ CPU内核,添加以太网、Flash、PIO以及VGA接口等模块,生成了一个Nios CPU内核,完成硬件设计。 软件设计部分,研究了嵌入式操作系统的发展、种类、特点等,简单介绍了几种代表性的嵌入式操作系统。选择嵌入式操作系统时,综合考虑了内核、可移植性、可裁剪性、外挂模块、成本、服务等各种因素,最终选用μCLinux操作系统。详细介绍了μCLinux的特点、基本架构、代码结构等。利用NiosⅡIDE为宿主机建立Linux开发环境。在IDE里配置Linux内核和文件系统,编译后上载到做好的硬件平台上。启动μCLinux后将一个C语言编写的九宫格求解程序下载到开发板中运行,检验运行结果,验证嵌入式系统的正确性。 论文所做的只是嵌入式系统的一个应用实例。实际应用过程中,用户可以根据自己的实际需要对软硬件进行修改,以实现不同的功能。
上传时间: 2013-07-19
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