实时钟
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VHDL实现数字时钟
VHDL实现数字时钟，利用数码管和CPLD 设计的计数器实现一个数字时钟，可以显示小时，分钟，秒。程序主要要靠考虑十进制和六十进制计数器的编写。 以上实验的程序都在源代码中有详细的注释
2015-10-15
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实用型数字时钟
数字钟是采用数字电路实现对时,分,秒.数字显示的计时装置。由于数字集成电路的发展和石英晶体振荡器的广泛应用,使得数字钟的精度远远超过老式钟表。 钟表的数字化给人们生活带来了极大的方便，而且大大地扩展了钟表原先的报时功能。诸如定时自动报警、按...
2024-12-20
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