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多款FPGA CPLD开发板的原理图，很好的线路设计参考...

📅 2013-08-18

基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等...

📅 2013-08-18

PROTUES中简单图片显示,请多提意见.谢谢!...

📅 2013-08-20

多路18b20测温显示系统,可同时测量n个第三18b20...

📅 2013-08-21

关于FPGA的设计方面的诸多经验总结，讨论了设计方面应该注意的问题。...

📅 2013-08-21

多个Verilog和vhdl程序例子，可以作为初学者参考实例，按照电路结构写出HDL代码...

📅 2013-08-26

节点是网络系统的基本控制单元，论文提出了一种基于CPLD和多处理器结构的控制网络节点设计方案，它能够提高单节点并行处理能力，其模块化结构增强了节点的可靠性。...

📅 2013-08-31

基于CPLD的多功能信号发生器设计.PDF...

📅 2013-09-02

大型设计中FPGA的多时钟设计策略,很详细的描述了在FPGA设计中时钟设计的方法...

📅 2013-09-04

protel 常用封装内有200多个常用原件。...

📅 2013-09-11

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