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处理器芯片

  • 图像预处理及DSPCPCI桥接设计

    实时红外图像处理是红外成像制导的关键技术。本课题来源于兵器工业部第209研究所承担研制的红外成像制导技术背景下的红外图像信息处理机项目。 本文在总结国内外研究现状的基础上,做了大量红外图像信息处理系统硬件部分的设计工作。主要有以下几点: 1.系统方案和总体结构设计 在分析比较目前几种主流系统方案后,将红外图像处理机设计成“双FPGA+双DSP+CPCI”结构。选用ADI公司TigerSHARK系列的DSP芯片ADSP-TS201作为系统高层算法处理的核心处理器,选用Altera公司的FPGA芯片StratixⅡ EP2S60F67214作为底层算法处理和接口控制的核心,选用高速CPCI总线作为红外图像信息处理机与主机的通讯桥梁。 2.FPGA部分的设计是本课题的核心,对FPGA部分进行了设计和调试 (1)图像预处理模块:FPGA负责系统的底层预处理算法和相应控制。首先对采集来的图像数据进行中值滤波和直方图统计,然后按照链路口(Linkport)的通信协议,将预处理后的图像数据实时地从FPGA传给DSP。 (2)DSP-CPCI桥接模块:FPGA负责DSP与CPCI的接口,将DSP处理后的结果通过DSP-CPCI桥接模块传给主机。 联调实验测试表明,实时红外图像信息处理成功实现了对典型红外目标的检测、识别和跟踪,从而验证系统核心FPGA部分的设计是成功的。

    标签: DSPCPCI 图像预处理 桥接设计

    上传时间: 2013-07-13

    上传用户:gjzeus

  • 系统芯片SoC原型验证技术

    随着系统芯片(SoC)设计复杂度不断增加,使得缩短面市时间的压力越来越大。虽然IP核复用大大减少了SoC的设计时间,但是SoC的验证仍然非常复杂耗时。SoC和ASIC的最大不同之处在于它的规模和复杂的系统性,除了大量硬件模块之外,SoC还需要大量的同件和软件,如操作系统,驱动程序以及应用程序等。面对SoC数目众多的硬件模块,复杂的嵌入式软件,由于软件仿真速度和仿真模犁的局限性,验证往往难以达到令人满意的要求,耗费了大最的时间,将给系统芯片的上市带来严重的影响。为了减少此类情况的发生,在流样片之前,进行基于FPGA的系统原型验证,即在FPGA上快速地实现SoC设计中的硬件模块,让软件模块在真正的硬件环境中高速运行,从而实现SoC设计的软硬件协同验证。这种方法已经成为SoC设计流程前期阶段常用的验证方法。 在简要分析几种业内常用的验证技术的基础上,本文重点阐述了基于FPGA的SoC验证流程与技术。结合Mojox数码相机系统芯片(以下简称为Mojox SoC)的FPGA原型验证平台的设计,介绍了Mojox FPGA原型验证平台的硬件设计过程和Mojox SoC的FPGA原型实现,并采用基于模块的FPGA设计实现方法,加快了原型验证的工作进程。 本文还介绍了Mojox SoC中ARM固件和PC应用软件等原型软件的设计实现以及原型验证平台的软硬协同验证的过程。通过软硬协同验证,本文实现了PC机对整个验证平台的摔制,达到了良好的验证效果,且满足了预期的设计要求。

    标签: SoC 系统芯片 原型 验证技术

    上传时间: 2013-07-02

    上传用户:dsgkjgkjg

  • 基于NiosⅡ的FPGACPU调试技术研究

    本文研究了基于Nios Ⅱ的FPGA-CPU调试技术。论文研究了NiosⅡ嵌入式软核处理器的特性;实现了以Nios Ⅱ嵌入式处理器为核心的FPGA-CPU调试系统的软、硬件设计;对两种不同类型的FPGA-CPU进行了实际调试,对实验数据进行了分析。 在硬件方面,为了控制和检测FPGA-CPU,设计并实现了FPGA-CPU的控制电路、FPGA-CPU的内部通用寄存器组扫描电路、存储器电路等;完成了各种外围设备接口的设计;实现了调试系统的整体设计。 在软件方面,设计了调试监控软件,完成了对FPGA-CPU运行的控制和信号状态的监测。这些信号包括地址和数据总线以及各种寄存器的数据等;实现了多种模式下的FPGA-CPU调试支持单时钟调试、单步调试和软件断点多种调试模式。此外,设计了专用的编译软件,实现了基于不同指令系统的伪汇编程序编译,提高了调试效率。 本文作者在实现了FPGA-CPU调试系统基础上,对两种指令系统不同、结构迥异的FPGA-CPU进行实际调试。调试结果表明,这种基于IP核的可复用设计技术,能够在一个FPGA芯片内实现调试系统和FPGA-CPU的无缝连接,能够有效地调试FPGA-CPU。

    标签: FPGACPU Nios 调试 技术研究

    上传时间: 2013-05-19

    上传用户:xinyuzhiqiwuwu

  • 语音信号特征参数的提取

    随着语音技术应用的发展,语音信号数字处理的实时性要求越来越突出。这就要求在系统设计中,对系统的硬件环境要求更高。随着语音处理算法的日益复杂,用普通处理器对语音信号进行实时处理,已经不能满足需要。专用语音信号处理芯片能解决实时性的要求,同时对器件的资源要求也是最低的。 论文利用Altera公司的新一代可编程逻辑器件在数字信号处理领域的优势,对语音信号的常用参数—LPC(线性预测编码,Linear Predictive Coding)参数提取的FPGA(现场可编程门阵列,Field Programmable Gate Array)实现进行了深入研究。论文首先对语音的离散数学模型和短时平稳特性进行了分析,深入讨论了语音线性预测技术。第二,对解线性预测方程组的自相关法和协方差斜格法进行了比较,提出了一种基于协方差斜格法的LPC参数提取系统的总体设计方案。第三,对Altera公司的Cyclon系列可编程器件的内部结构进行了研究,分析了在QuartusⅡ开发平台上进行FPGA设计的流程。第四,对系统的各个功能模块进行了设计,所有算法通过Verilog硬件描述语言实现,并对其工作过程进行了详细的分析。最后,在Altera FPGA目标芯片EP1C6Q240C8上,对LPC参数提取系统进行了仿真验证。 系统具有灵活的输入输出接口,能方便地同其它语音处理模块相连,构成一个完整的语音处理专用芯片,可以应用于语音编解码、语音识别等系统。

    标签: 语音信号 特征 参数

    上传时间: 2013-04-24

    上传用户:TI初学者

  • 快速傅立叶变换(FFT)的FPGA实现

    随着数字电子技术的发展,数字信号处理的理论和技术广泛的应用于通讯、语音处理、计算机和多媒体等领域。快速傅立叶变换(FFT)使离散傅立叶变换的运算时间缩短了几个数量级,在数字信号处理领域被广泛应用。FFT已经成为现代信号处理的重要手段之一。 现场可编程门阵列(FPGA)是近年来迅速发展起来的新型可编程器件。随着它的不断应用和发展,也使电子设计的规模和集成度不断提高。同时基于FPGA实现FFT的设计方法和思想被提出。本次设计的目的是快速傅立叶变换(FFT)的FPGA实现。 此文在分析了快速傅立叶算法的基础上,提出了一种频率抽取基4 FFT的FPGA设计方案,针对现有FFT的FPGA实现过程中蝶形运算需要频繁乘以多个旋转因子提出了改进方法,减少了旋转因子的乘法次数和存储空间,加快了蝶形运算的速度,设计的地址映射方法,无需运算即可得到所需数据的存放地址,并结合采用乒乓结构和流水线方式,来提高快速傅立叶变换(FFT)FPGA实现的速度。描述了一片FPGA芯片内完成了整个FFT处理器的电路设计,经过模块时序仿真和数据的验证及测试,达到工作在50MHz时钟频率的设计要求。最后对后续设计做了描述,并对用FPGA实现FFT做了展望。

    标签: FPGA FFT 傅立叶变换

    上传时间: 2013-04-24

    上传用户:ykykpb

  • 纹理映射算法研究与FPGA实现

    纹理映射在计算机图形计算中属于光栅化阶段,处理的是像素,主要的特点是数据的吞吐量大,对实时系统来说转换的速度是一个关键的因素,人们寻求各种加速算法来提高运算速度。传统的方法是用更快的处理器,并行算法或专用硬件。随着数字技术的发展,尤其是可编程逻辑门阵列(FPGAs)的发展,提供了一种新的加速方法。FPGAs在密度和性能上都有突破性的发展,当前的FPGA芯片已经能够运算各种图形算法,而在速度上与专用的图形卡硬件相同。因此,FPGA芯片非常适合这项工作。 本文主要工作包括以下几个方面: 1、本文提出了一种MIPmapping纹理映射优化方法,改进了MIPmapping映射细化层次算法及纹理图像的存储方式,减少纹理寻址的计算量,提高纹理存储的相关性。详细内容请阅读第三章。 2、提出了一种MIPmapping纹理映射优化方法的硬件实现方案,该方案针对移动设备对功耗和面积的要求,以及分辨率不高的特点,在参数空间到纹理地址的计算中用定点数来实现。详细内容请阅读第四章。 3、实现了纹理映射流水线单元纹理地址产生电路,及纹理滤波电路的FPGA设计,并给出设计的综合和仿真结果。详细内容请阅读第五章4、实现了符合IEEE 754单精度标准的乘法、乘累加及除法运算器电路。乘法器采用改进型Booth编码电路以减少部分积数量,用Wallace对部分积进行压缩;乘累加器采用multiply-add fused算法,对关键路径进行了优化;除法器为基于改进型泰勒级数展开的查找表结构实现,查找表尺寸只有208字节,电路为固定时延,在电路尺寸、延时及复杂度方面进行了较好的平衡。

    标签: FPGA 映射 算法研究

    上传时间: 2013-04-24

    上传用户:yxvideo

  • 视频图像处理系统的研究

    视频图像处理的应用越来越广泛,各种处理算法也日趋成熟,相关的硬件技术不断地推陈出新。视频图像处理系统的硬件实现一般来说有三种方式:数字信号处理器(Digital Signal Processor)、专用集成芯片(Application Specific Integrated Circuit)和现场可编程逻辑门阵列(Field Programmable Gate Array)以及相关电路组成。最近几年,随着电子设计自动化(Electronic Design Automation)技术的迅速发展,使得基于FPGA的可编程片上系统(System On a Programmable Chip)逐渐成为嵌入式系统。应用的一种趋势。特别地,在视频图像处理系统设计中,数据量大,要求处理速度快,灵活性高,FPGA有其独特的优势。鉴于此,本文对基于FPGA和SOPC技术的视频图像处理系统进行了研究。 本文介绍了Xilinx公司FPGA的结构和功能特点,以及可编程片上系统的开发工具和片内系统设计流程。根据视频信号的相关知识,编写了视频图像处理IP核,构建了视频图像处理系统。整个系统以FPGA为核心器件,内嵌PowerPC405处理器模块,通过ⅡC总线完成视频解码芯片的初始化,总体上实现了对视频图像信号的采集、处理、存储和显示。 本文最后对系统进行了调试。经过实验验证,系统能正确和可靠地工作。整个系统的逻辑资源消耗占FPGA的百分之十几,剩余的资源可以做许多硬件算法或其它方面的应用。

    标签: 视频图像 处理系统

    上传时间: 2013-05-24

    上传用户:kaka

  • 基于ISD2560语音芯片的录放电路设计

    单片机AT98C2051与语音芯片ISD2560组成的电脑语音系统的设计方法, 给出了电脑语音系统的实际电路、录放音程序框图以及源程序。利用该方法设计的电脑语音系统具有硬件电路简单, 调试方便, 实用性强等特点, 并可作为电脑语音服务系统的语音板

    标签: 2560 ISD 语音芯片 录放

    上传时间: 2013-04-24

    上传用户:青春123

  • 基于DSP和FPGA的机载导航计算机设计

    本文针对应用于军用直升机上的Doppler/SINS组合导航系统对导航计算机高精度、高性能的要求,设计出一种基于DSP(TMS320C6713)和FPGA(Spartan-3E XC3S500E) 协同合作的机载导航计算机系统。在分析Doppler/SINS组合导航系统模型的特点和系统对导航计算机的需求后,提出了基于DSP和FPGA的机载导航计算机整体设计方案,该方案采用DSP负责导航解算,利用FPGA强大的内部资源扩展系统的通信接口,完成外围通信模块控制信号的整合。在导航计算机整体设计方案,包括硬件设计方案和软件设计方案确立的基础上,首先对 DSP和FPGA芯片进行选型,其次对实现各个功能模块的关键技术进行研究和开发,包括基于FPGA的数据通信模块、基于DSP的处理器模块以及数据存储模块,开发过程中做了大量的仿真和验证,最后对系统进行综合测试和联调,并进行了地面跑车实验。实验结果证明:系统能够实时采集IMU角速率和加速度、Doppler雷达的速度等信息,能够对IMU、Doppler、GPS、航姿系统、高度表等信息进行导航解算,生成当前位置、姿态等导航数据,并能够完成与机载电子设备间的数据通信与控制。多次的联调和跑车实验结果证明,机载导航计算机达到了预期设计的目的,可以有效提高导航系统的运算精度,实现了高性能、小体积、低成本的要求,系统具有较高的应用价值。关键词:Doppler/SINS组合导航,导航计算机,DSP,FPGA

    标签: FPGA DSP 机载 导航计算机

    上传时间: 2013-07-25

    上传用户:cc1915

  • 实验开发评估板设计与实现

    信号与信息处理是信息科学中近几年来发展最为迅速的学科之一,随着片上系统(SOC,System On Chip)时代的到来,FPGA正处于革命性数字信号处理的前沿。基于FPGA的设计可以在系统可再编程及在系统调试,具有吞吐量高,能够更好地防止授权复制、元器件和开发成本进一步降低、开发时间也大大缩短等优点。然而,FPGA器件是基于SRAM结构的编程工艺,掉电后编程信息立即丢失,每次加电时,配置数据都必须重新下载,并且器件支持多种配置方式,所以研究FPGA器件的配置方案在FPGA系统设计中具有极其重要的价值,这也给用于可编程逻辑器件编程的配置接口电路和实验开发设备提出了更高的要求。 本论文基于IEEE1149.1标准和USB2.0技术,完成了FPGA配置接口电路及实验开发板的设计与实现。作者在充分理解IEEE1149.1标准和USB技术原理的基础上,针对Altcra公司专用的USB数据配置电缆USB-Blaster,对其内部工作原理及工作时序进行测试与详细分析,完成了基于USB配置接口的FPGA芯片开发实验电路的完整软硬件设计及功能时序仿真。作者最后进行了软硬件调试,完成测试与验证,实现了对Altera系列PLD的配置功能及实验开发板的功能。 本文讨论的USB下载接口电路被验证能在Altera的QuartusII开发环境下直接使用,无须在主机端另行设计通信软件,其兼容性较现有设计有所提高。由于PLD(Programmable Logic Device)厂商对其知识产权严格保密,使得基于USB接口的配置电路应用受到很大限制,同时也加大了自行对其进行开发设计的难度。 与传统的基于PC并口的下载接口电路相比,本设计的基于USB下载接口电路及FPGA实验开发板具有更高的编程下载速率、支持热插拔、体积小、便于携带、降低对PC硬件伤害,且具备其它下载接口电路不具备的SignalTapII嵌入式逻辑分析仪和调试NiosII嵌入式软核处理器等明显优势。从成本来看,本设计的USB配置接口电路及FPGA实验开发板与其同类产品相比有较强的竞争力。

    标签: 实验 评估板

    上传时间: 2013-06-07

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