在点对多点主从通信系统中,需要合适的接口形式和通信协议实现主站与各从站的信息交换。RS -485 接口是适合这种需求的一种标准接口形式。当选择主从多点同步通信方式时,工作过程与帧格式符合HDLC/SDLC协议。介绍了采用VHDL 语言在FPGA 上实现的以HDLC/ SDLC 协议控制为基础的RS - 485 通信接口芯片。实验表明,这种接口芯片操作简单、体积小、功耗低、可靠性高,极具实用价值。
上传时间： 2013-11-02
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XAPP520将符合2.5V和3.3V I/O标准的7系列FPGA高性能I/O Bank进行连接 The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems
上传时间： 2013-11-19
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针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置到Altera公司Stratix III系列的EP3SL150F1152C2N中。测试结果表明，系统运行稳健可靠，并具有良好的移植性；集成化一体设计，为LTE标准下Turbo码 ASIC的开发提供了参考。
上传时间： 2013-10-28
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基于现场可编程门阵列（FPGA），设计了采用RS485标准的数据通信协议。其中，高速信号接收，采用同步485通信协议，高速接口包括时钟和数据两个信号，时钟速率3.6864 MHz，利用同步时钟上升沿检测数据。低速信号接收采用异步485通信协议，波特率115.2 kbps，每字节1个起始位，8个数据位，1个截止位。针对高速数据接收时的情况，加入1 MB 容量的静态存储器SRAM作为缓存，保证接收数据的可靠性。
上传时间： 2013-10-10
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最新蓝牙标准V4.0在Android平台上的应用
上传时间： 2013-11-10
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无线通讯标准入门级参考资料
上传时间： 2013-11-02
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无线通讯标准入门级参考资料
上传时间： 2013-10-20
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AFDX（ Avionics Full Duplex Switch Ethernet）是空客公司首先提出的， 在商用以太网技术的基础上，通过增加特殊功能来保证航空应用的确定性和可靠性，是目前最先进的机载通信网络。文中针对航电设备与总线网络通信出现的故障，设计了某型号飞机AFDX总线监控器，该设备是一个便携式工控机，通过扩展AFDX总线接口卡，实时、高速、可靠的对总线上的数据进行记录、分析、显示，并依照航电总线标准ICD（接口控制文件）库进行解析，快速准确的定位故障，避免设备的无故障拆装，提高维护效率。仿真实验表明：该监控器可实时监控航电AFDX 总线上的所有动态信息，对信息的分析处理正确，能满足设计需求。
上传时间： 2013-10-17
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ABB标准机架控制系统硬件介绍
上传时间： 2013-11-09
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为了适应变电站自动化功能的需求，采用IEC6185O标准，使用抽象通信服务接口ACSI和特殊通信服务映射SCSM技术建立了ACSI的服务模型。所建立的ACSI服务模型基本覆盖变电站自动化系统的功能需要，。能提供对模型中的数据进行读写、取代、报告、记录等服务，实现了应用和通信的分离。
上传时间： 2013-11-25
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