双DSP结构的捷联控制与解算系统设计
设计了基于双DSP 结构的捷联控制与解算系统,该系统以高性能的浮点处理器TMS320VC33 作为捷联系统实时解算的核心,以TMS320VC5402 作为通道控制、数据采集的控制核心,并结合F
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设计了基于双DSP 结构的捷联控制与解算系统,该系统以高性能的浮点处理器TMS320VC33 作为捷联系统实时解算的核心,以TMS320VC5402 作为通道控制、数据采集的控制核心,并结合F
·摘要: 设计了基于双DSP结构的捷联控制与解算系统.该系统以高性能的浮点处理器TMS320VC33作为捷联系统实时解算的核心,以TMS320VC5402作为通道控制、数据采集的控制核心.并结合FPGA的组合逻辑和时序逻辑,构成...
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