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双核微控制器

  • 基于ARM和Linux的嵌入式绣花机控制器的研究

    嵌入式系统广泛应用于各种智能控制器中,目前国外高端绣花机控制器主要采用高性能嵌入式微处理器,而国内绣花机控制器仍以单片机为主,存在绣花色泽单调,数据处理能力欠佳,缺乏图形控制界面等不足。本文在分析了绣花机的结构和功能的基础上,研制了基于Linux-2.6的嵌入式绣花机控制器,论文的主要工作和成果如下: (1)设计并实现了基于嵌入式微处理器的绣花机控制器开发平台,建立宿主机开发环境,制作了针对Linux-2.6的交叉编译器,实现了宿主机和目标机之间的数据传输,设计了基于双口RAM的双处理器通信接口。 (2)深入研究了嵌入式系统的引导装载程序vivi、Linux-2.6内核和根文件系统,成功移植了基于S3C2410硬件平台的vivi、嵌入式Linux-2.6操作系统和cramfs根文件系统,系统运行稳定可靠。 (3)对Linux-2.6内核设备驱动程序进行了分析和研究,在设备驱动程序开发原理的基础上,设计了基于Linux-2.6内核的IIC键盘驱动程序和双处理器通信接口驱动程序。 (4)深入分析了三种主流绣花机花样文件存储格式和解码方法,采用MiniGUI图形系统,设计实现了绣花机控制器的图形控制界面。

    标签: Linux ARM 嵌入式 绣花机

    上传时间: 2013-07-01

    上传用户:jackgao

  • 基于ARM的嵌入式强实时内核设计

    随着国内工业化、数字化的迅速发展,嵌入式开发在IT行业中的重要性越来越显著。嵌入式开发领域对产品的功能性、稳定性、实时性等方面的要求也越来越高。 采用嵌入式实时操作系统作为开发平台,以高性能的嵌入式处理器为工业控制等领域的主控制器可以有效地提高系统的可靠性、实时性、和软件编程的灵活性。在嵌入式处理器方面,ARM构架已经在高性能、低功耗、低成本的嵌入式领域里占领先地位。而在嵌入式操作系统方面,适合国内发展方向的解决方案以及系统基础结构方面并不理想。首先,国外成熟的嵌入式实时操作系统大都成本高、结构复杂,不适合强实时应用;其次,因大部分实时操作系统不公开源码,使开发的产品存在安全隐患。而类似μC/OS-II的小型强实时嵌入式操作系统内核虽然具有低成本、易控制、小规模、高性能等特性,但这类系统的基础较为薄弱,面临产品化和商业化还有一定的距离。 本文针对这种情况,结合现有的操作系统内核理论及嵌入式强实时系统的特殊需求,特别是对μC/OS-Ⅱ的研究分析基础上,面向强实时应用,设计、构造了一种适合在32位ARM处理器环境下使用的内核。这样做的目的是为了提供一个基础牢固、值得信赖的基本平台。 本文研究工作主要集中在以下几个方面: 针对嵌入式环境中高效、简洁、易扩展、易剪裁的要求,对内核体系结构框架进行了设计。内核整体上采用分层结构,在各层中采用功能相对独立的模块:在最底层借鉴微核的原理,只提供最基本的功能模块。 针对系统快速和稳定的实时响应能力需求,为IRQ中断建立了统一的中断入口,采用合理的半嵌套工作方式;保留FIQ为不可屏蔽中断,在快速反应场合使用;引入中断分段处理机制解决中断和任务的ITC机制共享,需要硬保护机制相互协调所引起的硬保护机制被隐性地泛滥使用问题。 针对应用提出的系统行为的可预测性需求,在调度算法方面采用基于优先级位图的抢占阈值调度算法,提高了处理器的利用率和任务集合的可调度性,减少了内核存储开销;在共享资源访问控制方面,以优先级天花板协议为依据,使用互斥事件解决优先级反转和死锁问题的发生。 为了保障系统的强实时性能,本文还对内核的时钟管理、内存管理等方面进行了设计。最后,通过实时性能测试,结果表明该实时内核有很好的强实时特性。

    标签: ARM 嵌入式 内核设计

    上传时间: 2013-04-24

    上传用户:alia

  • PCI从设备控制器的FPGA设计与实现

    随着星载电子系统复杂度、小型化需求的提高,SoC已经成为应对未来星载电子系统设计需求的解决途径。为了简化设计流程并且提高部件的可重用性,在目前的SoC设计中引入了称之为平台的体系结构模板,用它来描述采用已有的标准核来开发SoC的方法。在星载电子系统中常用部件的分类设计,最终建立一个包括多种功能部件,互连部件和处理部件的设计平台,从而有效的提高星载电子系统的设计能力。在当前NASA和ESA的空间应用中,PCI总线广泛作为背板总线和局部总线,有鉴于此,本研究选择PCI总线作为星载电子系统设计平台要提供的一个互连部件对其进行设计。 针对这一需求,本论文采用自项向下的设计方法对PCI总线从设备控制器的设计与实现进行了研究,对PCI总线协议做了深刻的分析,完成了PCI总线目标设备控制器的设计,采用Verilog HDL对其进行了RTL级的描述。 在该课题的研究中,采用了目前集成电路设计中常见的自顶向下设计方法,使用硬件描述语言Verilog HDL对其进行描述,重点分析了PCI总线设备控制器的设计。以PCI总线协议的分析和理解为基础,对PCI总线设备控制器进行了功能分析和结构划分。根据PCI总线设备控制器的功能和结构划分,对PCI总线目标设备控制器的设计思路和各个子模块电路的设计和实现进行了详细的分析阐述,并且通过编写测试激励程序完成了功能仿真。应用FPGA作为物理验证和实现载体,进行了面向FPGA的电路综合,进行了布局布线后的时序仿真,证明所实现的PCI目标设备控制器符合基本功能要求,在以上基础上完成了PCI目标设备控制器的FPGA实现。通过这整个论文的工作,按照设计、仿真、综合验证及布局布线的步骤,完成了PCI总线目标设备控制器IP软核的设计。

    标签: FPGA PCI 设备 控制器

    上传时间: 2013-06-07

    上传用户:tccc

  • 基于FPGA的8位增强型CPU设计与验证

    随着信息技术的发展,系统级芯片SoC(System on a Chip)成为集成电路发展的主流。SoC技术以其成本低、功耗小、集成度高的优势正广泛地应用于嵌入式系统中。通过对8位增强型CPU内核的研究及其在FPGA(Field Programmable Gate Arrav)上的实现,对SoC设计作了初步研究。 在对Intel MCS-8051的汇编指令集进行了深入地分析的基础上,按照至顶向下的模块化的高层次设计流程,对8位CPU进行了顶层功能和结构的定义与划分,并逐步细化了各个层次的模块设计,建立了具有CPU及定时器,中断,串行等外部接口的模型。 利用5种寻址方式完成了8位CPU的数据通路的设计规划。利用有限状态机及微程序的思想完成了控制通路的各个层次模块的设计规划。利用组合电路与时序电路相结合的思想完成了定时器,中断以及串行接口的规划。采用边沿触发使得一个机器周期对应一个时钟周期,执行效率提高。使用硬件描述语言实现了各个模块的设计。借助EDA工具ISE集成开发环境完成了各个模块的编程、调试和面向FPGA的布局布线;在Synplify pro综合工具中完成了综合;使用Modelsim SE仿真工具对其进行了完整的功能仿真和时序仿真。 设计了一个通用的扩展接口控制器对原有的8位处理器进行扩展,加入高速DI,DO以及SPI接口,增强了8位处理器的功能,可以用于现有单片机进行升级和扩展。 本设计的CPU全面兼容MCS-51汇编指令集全部的111条指令,在时钟频率和指令的执行效率指标上均优于传统的MCS-51内核。本设计以硬件描述语言代码形式存在可与任何综合库、工艺库以及FPGA结合开发出用户需要的固核和硬核,可读性好,易于扩展使用,易于升级,比较有实用价值。本设计通过FPGA验证。

    标签: FPGA CPU 8位 增强型

    上传时间: 2013-04-24

    上传用户:jlyaccounts

  • 基于ARM的嵌入式运动控制器研究

    基于ARM的嵌入式运动控制器是集计算机数字控制技术、ARM技术、运动控制技术以及嵌入式操作系统技术等技术为一体的技术含量高的运动控制器;是对低成本、高性能运动控制器研究的一个新的尝试。本论文的研究重是点基于双端口RAM上下位机通讯的数控系统总体软件架构设计、嵌入式运动控制器轨迹规划算法的研究、嵌入式系统软件的构建以及运动控制器外设驱动程序的开发,其主要工作及成果如下: 1.针对数控系统上下位机信息交互频繁,提出了一种基于双端口RAM通讯结构的上下位机交互方式,实现了上下位机信息的高速、稳定通讯;且完成了基于双端口RAM上下位机通讯结构的数控系统总体软件架构设计。 2. 针对目前高速数控加工轨迹规划中存在的一些关键问题进行深入的探讨。提出一种轨迹拐角的速度平滑方法,当高速加工不在同一直线方向而形成拐角的加工段时,在拐角过渡时能获得很好的速度响应和较小的轮廓误差;还提出了一种高速数控加工小线段的前瞻平滑算法,当高速加工多段微小直线段时,能够优化规划多段微小线段的加工速度,有效避免了频繁的加减速给系统带来较大冲击以及加工效率低的问题。 3. 构建了适合本运动控制器系统的系统软件;研究了嵌入式运动控制器引导程序的移植、嵌入式Linux内核的优化配置以及根文件系统的构建。 4.探讨了Linux驱动程序开发的原理以及流程;并以双端口RAM为例介绍了运动控制外设驱动程序开发的方法。

    标签: ARM 嵌入式 运动控制器

    上传时间: 2013-07-02

    上传用户:笨小孩

  • 基于ARM平台的嵌入式网络控制器的设计与实现

    随着计算机技术、通信技术、集成电路技术和控制技术的发展,传统的工业控制领域正经历着一场前所未有的变革,开始向网络化方向发展。本文即从未来工业控制网络发展的需要出发,设计并实现了以S3C2410微处理器为核心的嵌入式网络控制器。 本文以S3C2410-32 位微处理为核心,设计并实现了具有1路以太网接口、1路 USB Host 接口、1路USB Device 接口、3路RS232串口、1个CAN总线扩展卡、1个RS485扩展卡、1个RS422扩展卡使用、8路A/D、1路D/A、4路 PWM、一个 240×320TFT LCD 显示触摸屏的功能强大的嵌入式网络控制器。并在此基础上,结合嵌入式操作系统Windows CE建立了一个嵌入式软件开发平台。 在深入研究和分析CANopen协议的基础上,实现了基于Windows CE 的嵌入式 CANopen 协议栈,大大提高了嵌入式网络控制器在现场总线上的通信和控制能力,为新型的网络控制算法研究提供了实验平台。在探讨了TCP/IP协议的基础上研究了基于 Windows CE 的嵌入式 TCP/IP 协议栈,掌握了Windows CE 平台的网络 Socket 通信编程,使控制器能够通过以太网接到Intranet或Intemet上。 在完成嵌入式网络控制器硬件与软件设计的基础上,将控制器应用到了网络化的嵌入式数控系统的中央数控单元中,实现数控系统等数控设备小型化、网络化和集成化的需要。并以此为基础,结合计算机控制实验室建设,构建了三层(信息层、控制层和设备层)工业网络实验平台,实现了实验室设备真正的网络互连,为网络控制研究提供了一个高性能的平台。

    标签: ARM 嵌入式网络 控制器

    上传时间: 2013-06-10

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  • TDSCDMA频点拉远系统的FPGA设计与实现

    随着TD—SCDMA技术的不断发展,TD—SCDMA系统产品也逐步成熟并随之完善。产品家族日益丰富,室内型宏基站、室外型宏基站、分布式基站(BBU+RRU)、微基站等系列化基站产品逐步问世,可以满足不同场景的建网需求。而分布式基站(BBU+RRU)越来越多地受到业界的关注和重视。 本文主要从TD—SCDMA频点拉远系统(RRU)和软件无线电技术的发展入手,重点研究TD—SCDMA频点拉远系统的FPGA设计与实现。TD—SCDMA通信系统通过灵活分配不同的上下行时隙,实现业务的不对称性,但是多路数字中频所构成的系统成本高和控制的复杂性,以及TDD双工模式下,系统的峰均比随时隙数增加而增加,对整个频点拉远系统的前端放大器线性输入提出了很高的要求。TD—SCDMA系统使用软件无线电平台,一方面软件算法可以有效保证时隙分配的准确性,保证对前端控制器的开关控制,以及对上下行功率读取计算和子帧的灵活提取,另一方面灵活的DUC/CFR算法可以有效的提高频带利用率和抗干扰能力,有效的控制TDD系统的峰均比,有效降低系统对前端放大器线性输出能力的要求。 本文主要研究软件无线电中DUC和CFR的关键技术以及FPGA实现,DUC主要由3倍FIR内插成型滤波器、2倍插值补偿滤波器以及5级CIC滤波器级联组成;而CFR主要采用类似基带削峰的加窗滤波的中频削峰算法,可以降低相邻信道的溢出,更有效的降低CF值。将DUC/CFR以单片FPGA实现,能很好提高RRU性能,减少其硬件结构,降低成本,降低功耗,增加外部环境的稳定性。

    标签: TDSCDMA FPGA 频点

    上传时间: 2013-04-24

    上传用户:18752787361

  • 基于FPGA的汽车发动机控制器研究

    汽车工业在国民经济增长中发挥着越来越重要的作用。近几年,虽然我国的汽车工业已经得到了飞速的发展,但汽车ECU(Electronic Control Unit)的设计制造一直无法实现国产化,严重制约了汽车工业的发展。针对这个现状,本课题对于ECU的设计进行了初步研究。首次尝试了基于SOPC技术的ECU系统设计,并利用dSPACE实时仿真发动机,完成了ECU的硬件在回路仿真,对控制效果进行了测试和分析。 目前,市场上的ECU系统都是基于专用单片机的。本文首先对现有的汽车发动机控制器结构进行了分析比较,总结出ECU的主要组成部件;而后通过各类方案的对比,确定了本课题采用基于FPGA的嵌入NIOS Ⅱ软核的SOPC技术方案。 之后,进行了汽车发动机模型搭建和控制算法的设计。发动机模型以Hendricks提出的均值模型为基础,参考mathworks公司的发动机建模方案进行设计。并在该模型基础上,参考Fekete提出的针对多缸发动机的基于模型的空燃比控制策略和mathworks发动机控制方案,建立了以控制空燃比为核心的发动机喷油控制算法。并通过simulink的仿真,验证了模型和算法的合理有效性。 基于系统设计总体方案,完成了ECU硬件电路设计,并在该系统中完成了上述算法的移植和优化。最后,利用dSPACE实时仿真发动机,进行ECU的硬件在回路仿真,对本文设计的ECU系统进行了测试。证实了该ECU方案在空燃比控制方面取得了较好的效果。 本论文以大量的图示形式介绍了发动机模型和系统软硬件设计,使得系统结构和软件流程等一目了然,浅显易懂。同时论文中采用的基于SOPC技术的ECU设计具有一定创新性,对于其他ECU系统的开发和设计具有一定指导意义。

    标签: FPGA 汽车发动机 控制器

    上传时间: 2013-07-11

    上传用户:小眼睛LSL

  • 用Xilinx_FPGA实现DDR_SDRAM控制器

    ·摘要:  DDB SDRAM使用双倍数据速率结构,它能获得比SDRAM更高的性能.DDR SDRAM需要特定的DDB控制器才能完成与DSP、FPGA之间的通信.由于Xilinx VirtexTM-4系列FPGA具备ChipSync源同步技术等优势,本设计采用它来实现DDRSDRAM控制器.该DDR SDRAM控制器采用直接时钟数据捕获技术,本文将重点阐述该技术. 

    标签: Xilinx_FPGA DDR_SDRAM 控制器

    上传时间: 2013-05-24

    上传用户:zxc23456789

  • 针对嵌入式系统的底层网络接口给出了一种由FPGA实现的以太网控制器的设计方法

    针对嵌入式系统的底层网络接口给出了一种由FPGA实现的以太网控制器的设计方法.该控制器能支持10Mbps和100Mbps的传输速率以及半双工和全双工模式,同时可提供MII接口,可并通过外接以太网物理层(PHY)芯片来实现网络接入\r\n

    标签: FPGA 嵌入式系统 以太网控制器 底层

    上传时间: 2013-08-18

    上传用户:青春给了作业95