节点是网络系统的基本控制单元,论文提出了一种基于CPLD和多处理器结构的控制网络节点设计方案,它能够提高单节点并行处理能力,其模块化结构增强了节点的可靠性。
上传时间: 2013-08-31
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针对数字钟双面板设计较为复杂的问题,利用国内知名度最高、应用最广泛的电路辅助设计软件Protel dxp 2004进行了电路板设计,本文提供了设计的一些方法和技巧,快速、准确地完成数字钟双面电路板的设计,采用双面板设计,布线面积是同样大小的单面板面积的两倍,其布线可以在两面间互相交错,所以更节省空间。
上传时间: 2013-10-07
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给出了一种快速设计任意弱耦合非对称渐变线定向耦合器的方法,以线性渐变为基础,通过仿真优化获取最优渐变,摆脱了传统方法中的复杂运算。为改善定向耦合器在频率高端的定向性,在结构上引入了锯齿加载。设计了一个带宽为0.5GHz到20GHz,耦合度为-25dB的定向耦合器,利用三维电磁仿真软件HFSS进行了结果验证。
上传时间: 2013-10-21
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为了快速有效地判断化学物质中的微量成分,并粗略估计成分的含量,提出一种便携式分光光度计的设计方案,对该方案的光谱采集系统进行了设计与讨论。与传统的分光光度计设计方案相比,该方案采用线阵CCD器件代替传统的光电管来实现光电信号的转换,易于提高系统的运行速度并减少系统体积;利用FIFO(先入先出队列)可以实现高速数据输出设备与低速控制器的数据交换。本系统可以选择LCD液晶或者电脑端屏幕来显示数据,并能快速地在两种显示方式之间进行切换。为了直观的在液晶上显示采集的光谱,方案使用了插值压缩技术。实验证明,系统在两种显示方式下稳定工作,并能实现光谱数据快速有效地显示。
上传时间: 2013-11-20
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双频式定子接地保护是目前在中小型发电机中得到广泛应用的一种发电机保护,三次谐波的变化情况是这种保护动作的依据之一。文中着重就能够从发电机机端和中性点侧电压中初步提取三次谐波的模拟滤波器的设计进行了讨论,通过分析比较各类滤波器的阻带衰减速度、通频带平坦度等特点以及生产实际装置的成本等多方面因素设计出了一款能够满足保护装置要求的模拟滤波器。从仿真及实验结果中可以看出,此款模拟滤波器具有良好的应用效果。
上传时间: 2013-10-13
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利用pHEMT工艺设计了一个2~4 GHz宽带微波单片低噪声放大器电路。本设计中采用了具有低噪声、较高关联增益、pHEMT技术设计的ATF-54143晶体管,电路采用二级级联放大的结构形式,利用微带电路实现输入输出和级间匹配,通过ADS软件提供的功能模块和优化环境对电路增益、噪声系数、驻波比、稳定系数等特性进行了研究设计,最终使得该LNA在2~4 GHz波段内增益大于20 dB,噪声小于1.2 dB,输出电压驻波比小于2,达到了设计指标的要求。
上传时间: 2014-07-03
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根据三角级数展开理论,将理想滤波器特性曲线做级数展开,然后用单节微带线逼近展开式中的一项或多项,级联后逼近理想的滤波器特性曲线。该方法避免了传统滤波器设计方法中的微带线建模分析的困难,在设计出的电路形式中,各单元的作用更易理解,给滤波器的调节也带来了方便。最后给出了该方法的设计实例,具有较好的频率特性曲线。
标签: 微波滤波器
上传时间: 2013-10-20
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555 定时器是一种模拟和数字功能相结合的中规模集成器件。一般用双极性工艺制作的称为 555,用 CMOS 工艺制作的称为 7555,除单定时器外,还有对应的双定时器 556/7556。555 定时器的电源电压范围宽,可在 4.5V~16V 工作,7555 可在 3~18V 工作,输出驱动电流约为 200mA,因而其输出可与 TTL、CMOS 或者模拟电路电平兼容。 555 定时器成本低,性能可靠,只需要外接几个电阻、电容,就可以实现多谐振荡器、单稳态触发器及施密特触发器等脉冲产生与变换电路。它也常作为定时器广泛应用于仪器仪表、家用电器、电子测量及自动控制等方面。555 定时器的内部包括两个电压比较器,三个等值串联电阻,一个 RS 触发器,一个放电管 T 及功率输出级。它提供两个基准电压VCC /3 和 2VCC /3 555 定时器的功能主要由两个比较器决定。两个比较器的输出电压控制 RS 触发器和放电管的状态。在电源与地之间加上电压,当 5 脚悬空时,则电压比较器 A1 的反相输入端的电压为 2VCC /3,A2 的同相输入端的电压为VCC /3。若触发输入端 TR 的电压小于VCC /3,则比较器 A2 的输出为 1,可使 RS 触发器置 1,使输出端 OUT=1。如果阈值输入端 TH 的电压大于 2VCC/3,同时 TR 端的电压大于VCC /3,则 A1 的输出为 1,A2 的输出为 0,可将 RS 触发器置 0,使输出为 0 电平。
上传时间: 2013-10-15
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单电源运算放大器
上传时间: 2013-11-17
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设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构,利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度,100 MS/s采样频率的高速流水线(Pipelined)ADC的运放。设计基于SMIC 0.25 μm CMOS工艺,在Cadence环境下对电路进行Spectre仿真。仿真结果表明,在2.5 V单电源电压下驱动2 pF负载时,运放的直流增益可达到124 dB,单位增益带宽720 MHz,转换速率高达885 V/μs,达到0.1%的稳定精度的建立时间只需4 ns,共模抑制比153 dB。
上传时间: 2014-12-23
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