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基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案...

📅 2013-08-19

针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的\r\n新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数...

📅 2013-08-22

关于数字锁相环的一点东西,可以下来看看\r\n...

📅 2013-08-26

Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，...

📅 2013-08-28

基于CPLD-FPGA的半整数分频器的设计，用于设计EDA...

📅 2013-09-03

半整数分频器电路的VHDL源程序，供大家学习和讨论。\r\n...

📅 2013-09-04

              意法半导体静电计单相组合解决方案 ...

📅 2013-10-23

全国大学生电子设计（课题：波形的合成与分解） 1 任务设计制作一个具有产生多个不同频率的正弦信号，并将这些信号再合成为近似方波和三角波功能的电路。系统示意图如图1所示： 2要求 2.1 方波振荡器的...

📅 2013-10-11

锁相放大器资料。...

📅 2013-11-28

锁相环...

📅 2014-12-23

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