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制器设计

  • 多路多节功分器的设计与传输线问题的研究

    文章的设计是采用内部互联一分二功分器的方法来实现多路功分器, 因为实际制作中很难将一分二功分器直接相连, 所以在一分二功分器之间需要采用传输线进行连接, 本文主要研究了内部互联多路多节功分器的性能以及传输线对内部互联多路多节功分器的影响。

    标签: 多路 功分器 传输线

    上传时间: 2013-10-26

    上传用户:15501536189

  • 多功能低功耗海洋数据采集器的设计

        为了克服国内数据采集器通用性不强,论文以C8051F120为控制核心设计了通用多功能低功耗海洋数据采集器。多功能低功耗海洋数据采集器采用B1203LS非线性变压模块,降低了系统的功耗;采用了OCM12864-8液晶显示设计,实现了系统的菜单化管理;采用大容量存储器AT45DB041,可以存储大量历史数据;并提供了RS232接口可以实现远程有线或者无线传输。整个系统有体积小、功耗低、太阳能供电的特点,完全达到设计要求,有较大的实用价值和应用前景。

    标签: 多功能 低功耗 海洋数据 采集器

    上传时间: 2013-11-05

    上传用户:lyy1234

  • 用汇编设计的基于文本编辑器

    1 任务 设计一个文本编辑器。 2 基本要求 1 如图所示,设计一个有菜单栏的编辑窗口,在该窗口可以实现文本的输入,利用DEL键、BackSpace键、Home键、End键、上下左右光标键,实现对输入文本的全屏幕编辑。 2 实现文件的新建、打开、保存、另存为与退出等功能。 包含 设计思路、技术报告、和不同阶段的设计源代码 扩展要求 1 要求使用彩色组和背景颜色来设计界面颜色。 2 模拟一些著名编辑器(如Source Insight)的其它功能,如比较详细的帮助功能,对特定的命令或保留字(如C语言或汇编语言)能显示不同的醒目颜色。 3 自己参考其它编辑器进行发挥。

    标签: 汇编 文本编辑器

    上传时间: 2013-11-03

    上传用户:lhc9102

  • 电子灭蚊器详细设计资料

         电子灭蚊器详细设计资料 学者研究只有母蚊子会咬人,母蚊于产卵期间,需要吸吮人类或动物之血液以补充其养分,此期间极度不喜欢公蚊靠近,利用此一习性,用公蚊的声音加入超音波内,频率为5000-9000赫兹,可达到驱逐母蚊的目的。可以通过模仿蚊子的天敌--蜻蜓的频率,这种技术最先使用于战场,经过一系列的革新以后更趋完善。它采用放射超声波和音频的手段,模仿最能捕杀蚊子的蜻蜓所发出的声音和频率,达到驱蚊效果。它安全无毒无辐射,对人和动物完全无害,无任何化学物残留,是郊游、旅行、钓鱼、烧烤、露营、乘凉、岗哨守卫、居家生活的理想伴侣。对环境安全有保障,不会对人体有害。

    标签: 电子灭蚊器 详细设计资料

    上传时间: 2013-11-23

    上传用户:skhlm

  • 555定时器电路设计软件

    555定时器电路设计软件(亲自使用,绿色)

    标签: 555 定时器电路 设计软件

    上传时间: 2013-11-07

    上传用户:gai928943

  • 555定时器电路设计软件

    555定时器电路设计软件(亲自使用,绿色)

    标签: 555 定时器电路 设计软件

    上传时间: 2013-11-16

    上传用户:cknck

  • 设计实例2:MP3播放器硬件电路设计

    MP3播放器硬件电路设计实例

    标签: MP3 设计实例 播放器 硬件电路设计

    上传时间: 2013-12-31

    上传用户:zczc

  • 基于FPGA的RS码译码器的设计

    介绍了符合CCSDS标准的RS(255,223)码译码器的硬件实现结构。译码器采用8位并行时域译码算法,主要包括了修正后的无逆BM迭代译码算法,钱搜索算法和Forney算法。采用了三级流水线结构实现,减小了译码器的时延,提高了译码的速率,使用了VHDL语言完成译码器的设计与实现。测试表明,该译码器性能优良,适用于高速通信。

    标签: FPGA RS码 译码器

    上传时间: 2013-12-13

    上传用户:yzhl1988

  • 用VerilogHDL实现基于FPGA的通用分频器的设计

    用VerilogHDL实现基于FPGA的通用分频器的设计

    标签: VerilogHDL FPGA 分频器

    上传时间: 2015-01-02

    上传用户:oooool

  • LTE标准下Turbo码编译码器的集成设计

    针对固定码长Turbo码适应性差的缺点,以LTE为应用背景,提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长,平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法,对 Turbo编译码系统模块化设计后优化统一,经时序仿真验证后下载配置到Altera公司Stratix III系列的EP3SL150F1152C2N中。测试结果表明,系统运行稳健可靠,并具有良好的移植性;集成化一体设计,为LTE标准下Turbo码 ASIC的开发提供了参考。

    标签: Turbo LTE 标准 编译码器

    上传时间: 2013-10-08

    上传用户:回电话#