用最少的CPLD资源,用Verilog在QuartusII7.1上实现的1280分频.
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基于VHDL的分频器设计,这是源码希望对大家有用。...
实现任意小数分频的VHDL源代码,我自己写的,仿真结果是正确的,希望对大家有用!我是打算将400M的时钟分为57.344M...
实现去中间频带法实现宽间隔跳频处理,该程序为一个是实现函数...
FPGA里面的分频器相关资料...
用VHDL硬件描述语言实现的良好运行的三分频电路...
使用VHDL语言写的一些奇次和偶次分频源程序,在使用CPLD/FPGA的过程中有一定的参考价值...
利用matlab编写的小波分解分频和除躁程序,分为高低频率,并除去噪声,达到较好的效果。...
任意整数分频,很好,欢迎大家使用,有疑问请即时跟我联系...
三分频源代码设计,适合初学真...