📚 下降沿技术资料

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使用51实现的高速电流下降沿记录，...

📅 2014-01-26 👤 xlcky

高速电流记录

PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF...

📅 2014-06-09 👤 daguda

数据 Q5 PLL 输入

微机键盘和单片机的接口程序,采用了上升沿触发中断服务程序,下降沿触发中断服务程序....

📅 2014-01-01 👤 l254587896

触发中断服务程序微机

通过计算不了1S内下降沿个数,达到测频目的....

📅 2015-10-02 👤 jichenxi0730

计算测频

74hc595驱动 gcc编译 n个级连只要输出n个字节后加一个锁存时钟（下降沿）...

📅 2015-11-11 👤 TF2015

595 gcc 74 hc

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